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资料编号:842354
 
资料名称:LC72136N
 
文件大小: 319K
   
说明
 
介绍:
PLL Frequency Synthesizer for Electronic Tuning
 
 


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非. 5608-10/23
lc72136n, 72136nm
di 控制 数据 功能
非. 控制 块/数据 描述 related 数据
可编程序的 分隔物 数据 数据 那 sets 这 可编程序的 分隔物
p0 至 p15 一个 二进制的 值 在 这个 p15 是 这 msb. 这 lsb 改变 取决于 在 dvs 和 sns.
便条: p0 至 p3 是 ignored 当 p4 是 这 lsb.
dvs, sns 选择 这 信号 输入 管脚 (amin 或者 fmin) 为 这 可编程序的 分隔物, switches 这
频率 范围, 和 确定 这 bof 管脚 输出 状态. (
*
: don’t 小心.)
便条: 看 这 “programmable divider” item 为 详细信息.
涉及 分隔物 数据 涉及 频率 (fref) 选择 数据
r0 至 r3
便条: pll inhibit
这 可编程序的 分隔物 和 如果 计数器 blocks 是 stopped, 这 fmin, amin,
和 ifin 管脚 go 至 这 牵引的-向下 状态, 和 这 承担 打气 输出 管脚 变得 至
这 高-阻抗 状态.
XS 振荡器 余裕 选择 数据
xs = 0: “reduction mode” 这 振荡器 余裕 是 减少 和 这 结晶 辐射
是 减少.
xs = 1: 正常的 模式.
正常的 模式 是 选择 下列的 一个 电源-在 重置.
如果 计数器 控制 数据 如果 计数器 度量 开始 规格
CTE cte = 1: 计数器 开始
cte = 0: 计数器 重置
gt0, gt1 如果 计数器 度量 时间 determination
便条: 看 这 “if 计数器 structure” item 为 详细信息.
i/o 端口 规格 数据 数据 那 specifies 输入 或者 输出 为 这 i/o 双-使用 管脚
ioc1, ioc2 数据: 0 = 输入 模式, 1 = 输出 模式
输出 端口 数据 bo1 至 bo5, io1, 和 io2 输出 状态 数据
bo1 至 bo5, io1, io2 数据: 0 = 打开, 1 = 低
“data = 0: open” 是 选择 下列的 一个 电源-在 重置.
(1)
(2)
(3)
(4)
(5)
IFS
IOC1
IOC2
DVS SNS LSB divisor 设置 (n) 真实的 divisor
1
*
P0 272 至 65535 两次 这 值 的 这 设置
0 1 P0 272 至 65535 这 值 的 这 设置
0 0 P4 4 至 4095 这 值 的 这 设置
DVS SNS 输入 管脚 输入 频率 范围 bof 管脚
1
*
FMIN 10 至 160 mhz
0 1 AMIN 2 至 40 mhz 打开
0 0 AMIN 0.5 至 10 mhz 打开
GT1 GT0 度量 时间 (ms) wait 时间 (ms)
0 0 4 3 至 4
0 1 8 3 至 4
1 0 32 7 至 8
1 1 64 7 至 8
R3 R2 R1 R0 涉及 频率 (khz)
0 0 0 0 25
0 0 0 1 25
0 0 1 0 25
0 0 1 1 25
0 1 0 0 12.5
0 1 0 1 6.25
0 1 1 0 3.125
0 1 1 1 3.125
1 0 0 0 5
1 0 0 1 5
1 0 1 0 5
1 0 1 1 1
1 1 0 0 3
1 1 0 1 15
1 1 1 0 pll inhibit + xtal osc 停止
1 1 1 1 pll inhibit
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