AD7376AR100_集成电路资料查询网

AD7376
–10–
rev. 0
这 数据 建制 和 数据 支撑 时间 在 这 规格 表格
决定 这 数据 有效的 时间 (所需的)东西. 这 last 七 位
的 这 数据 文字 entered 在 这 串行 寄存器 是 使保持 当
CS
returns 高. 在 这 一样 时间
CS
变得 高 它 transfers 这
7-位 数据 至 这 vr 获得.
SHDN
SDI
CLK
CK
D
Q
RS
CS
串行
寄存器
RS
SDO
图示 42. detail sdo 输出 图式 的 这 ad7376
所有 数字的 输入 是 保护 和 一个 序列 输入 电阻 和
并行的 齐纳 静电释放 结构 显示 在 图示 43. 应用 至
数字的 输入 管脚
CS
, sdi, sdo,
RS
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SHDN
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100

V
DD
逻辑
图示 43. 相等的 静电释放 保护 电路
V
SS
一个,b,w
V
DD
图示 44. 相等的 静电释放 保护 相似物 管脚

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AD7376 –10– rev. 0 这数据建制和数据支撑时间在这规格表格决定这数据有效的时间 (所需的)东西. 这 last 七位的这数据文字 entered 在这串行寄存器是使保持当 CS returns 高. 在这一样时间 CS 变得高它 transfers 这 7-位数据至这 vr 获得. SHDN SDI CLK CK D Q RS CS 串行寄存器 RS SDO 图示 42. detail sdo 输出图式的这 ad7376 所有数字的输入是保护和一个序列输入电阻和并行的齐纳静电释放结构显示在图示 43. 应用至数字的输入管脚 CS , sdi, sdo, RS , SHDN , clk 100  V DD 逻辑图示 43. 相等的静电释放保护电路 V SS 一个,b,w V DD 图示 44. 相等的静电释放保护相似物管脚

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