MT8985
数据 薄板
7
zarlink 半导体 公司
图示 3 - 地址 记忆 编排
便条: "x" don’t 小心
软件 控制
这 地址 线条 在 这 微处理器 接口 给进入 至 这 mt8985 内部的 寄存器 和 memories. 如果
这 a5,a1,a0 地址 线条 输入 是 低, 然后 这 mt8985内部的 控制 寄存器 是 addressed (看 图示 3).
如果 a5 输入 线条 是 高, 然后 这 remaining 地址 在放 线条 是 使用 至 选择 记忆 subsections 的 32
locations 相应的 至 这 号码 的途径 每 输入 或者 输出 stream. 作 explained在 这 控制 寄存器
描述, 这 地址 输入 线条 和 这 stream 地址位 (sta) 的 这 控制 寄存器 给 这 用户 这
能力 的 selecting 所有 positions 的这 mt8985 数据 和 连接 memories.
这 数据 在 这 控制 寄存器 consists 的 分割 记忆 和 message 模式 位, 记忆 选择 和 stream
地址 位 (看 图示 4). 这 记忆 选择 位 al低 这 连接 记忆 高 或者 低 或者 这 数据 记忆
至 是 选择, 和 这 stream 地址 位 定义 一个 在ternal 记忆 subsections 相应的 至 输入 或者 输出
st-总线 streams. 位 7 (分割 记忆) 的 这 控制 寄存器 准许 分割记忆 运作 凭此 读 是 从
这 数据 记忆 和 写 是 至 这 连接 记忆 低.
这 message 使能 位 (位 6) places 每 输出 channel 在 每 输出 stream 在 message 模式; i.e., 这
内容 的 这 连接 记忆 低 (cml) 是 输出在 这 st-总线 输出 streams once 每 框架 除非
这 ode 输入 管脚 是 低. 如果 me 位 是 高, 然后 the mt8985 behaves 作 如果 位 2 (message 频道) 和 0
(输出 使能) 的 每 连接 记忆 高 (cmh) locations 是 设置 至 高, regardless 的 这 真实的 值.
如果 me 位 是 低, 然后 位 2 和 0 的 各自 连接 记忆 high location 运作 正常情况下. 在 这个 情况, 如果 位 2 的
这 cmh 是 高, 这 有关联的 st-总线 输出 频道 是 在 message 模式. 如果 位 2 的 这 cmh 是 低, 然后 这
内容 的 这 cml 定义 这 源 信息 (stream 和频道) 的 这 时间 slot that 是 至 是 切换 至 一个
输出.
如果 这 ode 输入 管脚 是 低, 然后 所有 串行 输出 是高-阻抗. 如果 ode 是 高, 然后 位 0 (输出 使能)
的 这 cmh location 使能 (如果 高) 或者 使不能运转 (如果 low) 这 输出 驱动器 为 the 相应的 单独的 st-
总线 输出 stream 和 频道.
这 内容 的 位 1 (csto) 的 各自 连接 记忆 高location (看 图示 5) 是 输出 在 csto 管脚 once
每 框架. 这 csto 管脚 是 一个 2048 mbit/s 输出 which carries 256 位. 如果 csto 位 是 设置 高, 这
相应的 位 在 csto 输出 是 transmitted 在 高.如果 csto 位 是 低, 这 相应的 位 在 这 csto
输出 是 transmitted 在 低. 这 内容 的 这 256 csto位 的 这 cmh 是 transmitted sequentially 在 至 这
csto 输出 管脚 和 是 同步的 至 这 st-总线 streams.至 准许 为 延迟 在 任何 外部 控制 电路系统 这
内容 的 这 csto 位 是 输出 一个 频道 在之前 这 相应的 频道 在 这 st-总线 streams. 为
例子, 这 内容 的 csto 位 在 位置 0 (st0, ch0) 的 这 cmh, 是 transmitted synchronously 和 st-总线
频道 31, 位 7. 这 内容 的 csto 位 在 位置32 (st1, ch0) 的 这 cmh 是 transmitted 在 st-总线
频道 31 位 6. 位 v/c (能变的/常量 延迟)在 这 连接 记忆 高 locations 准许 每-频道
选择 在 能变的 和 常数ant throughput 延迟 能力.
A5 A4 A3 A2 A1 A0 LOCATION
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1
1
1
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1
0
0
0
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控制 寄存器
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