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资料编号:961405
 
资料名称:74LV165DB
 
文件大小: 137K
   
说明
 
介绍:
8-bit parallel-in/serial-out shift register
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
飞利浦 半导体 产品 规格
74LV1658-位 并行的-在/串行-输出 变换 寄存器
2
1998 将 07 853–1915 19349
特性
宽 运行 电压: 1.0 至 5.5 v
accepts ttl 输入 水平 在 v
CC
= 2.7 v 和 v
CC
= 3.6 v
典型 v
OLP
(输出 地面 bounce) < 0.8 v 在 v
CC
= 3.3 v,
T
amb
= 25
°
C
典型 v
OHV
(输出 v
OH
undershoot) > 2 v 在 v
CC
= 3.3 v,
T
amb
= 25
°
C
异步的 8-位 并行的 加载
同步的 串行 输入
输出 能力: 标准
I
CC
类别: msi
描述
这 74lv165 是 一个 低-电压 si-门 cmos 设备 和 是 管脚 和
函数 兼容 和 74hc/hct165.
这 74lv165 是 一个 8-位 并行的-加载 或者 串行-在 变换 寄存器 和
complementary 串行 输出 (q
7
和 q
7
) 有 从 这 last
平台. 当 这 并行的 加载 (pl
) 输入 是 低, 并行的 数据 从 这
D
0
至 d
7
输入 是 承载 在 这 寄存器 asynchronously. 当 pl
是 高, 数据 enters 这 寄存器 serially 在 这 d
S
输入 和 shifts 一个
放置 至 这 正确的 (q
0
Q
1
Q
2
, 等.) 和 各自 积极的-going 时钟
转变. 这个 特性 准许 并行的-至-串行 转换器 expansion 用
tying 这 q
7
输出 至 这 d
S
输入 的 这 succeeding 平台.
这 时钟 输入 是 一个 gated-或者 结构 这个 准许 一个 输入 至 是
使用 作 一个 起作用的 低 时钟 使能 (ce
) 输入. 这 管脚 分派
为 这 cp 和 ce
输入 是 arbitrary 和 能 是 使反转 为 布局
应当 仅有的
引领 放置 当 cp 高 为 predictable 运作. 也 这 cp 或者
这 ce
应当 是 高 在之前 这 低-至-高 转变 的 pl
阻止 shifting 这 数据 当 pl
是 使活动.
快 涉及 数据
地 = 0 v; t
amb
= 25
°
c; t
r
= t
f
2.5 ns
标识
参数 情况 典型 单位
t
PHL
/t
PLH
传播 延迟
CE, cp 至 q
7
, q
7
PL至 q
7
, q
7
D
7
至 q
7
, q
7
C
L
= 15 pf;
V
CC
= 3.3 v
18
18
14
ns
f
最大值
最大 时钟 频率 78 MHz
C
I
输入 电容 3.5 pF
C
PD
电源 消耗 电容 每 门
V
CC
= 3.3 v
V
I
= 地 至 v
CC
1
35 pF
注释:
1. C
PD
是 使用 至 决定 这 动态 电源 消耗 (p
D
µ
w)
P
D
= c
PD
×
V
CC
2
×
f
i

(c
L
×
V
CC
2
×
f
o
f
i
= 输入 频率 在 mhz; c
L
= 输出 加载 电容 在 pf;
f
o
= 输出 频率 在 mhz; v
CC
= 供应 电压 在 v;
(c
L
×
V
CC
2
×
f
o
) = 总 的 这 输出.
订货 信息
包装 温度 范围 外部 北 america 北 america pkg. dwg. #
°
c 至 +125
°
C 74lv165 n 74lv165 n sot38-4
16-管脚 塑料 所以 –40
°
c 至 +125
°
C 74lv165 d 74lv165 d sot109-1
16-管脚 塑料 ssop 类型 ii –40
°
c 至 +125
°
C
16-管脚 塑料 tssop 类型 i –40
°
c 至 +125
°
C 74lv165 pw 74lv165pw dh sot403-1
管脚 配置
SV00585
1
2
3
4
5
6
PL
CP
D
4
D
5
D
6
D
7
V
CC
CE
D
3
16
15
14
13
12
11
7
8
D
S
Q
7
10
9
Q
7
D
2
D
1
D
0
管脚 描述
管脚 号码 标识 函数
1
PL 异步的 并行的 加载
2 CP
时钟 输入 (低 至
高, 边缘-triggered)
7 Q
7
complementary 输出 从
这 last 平台
8 地面 (0 v)
9 Q
7
串行 输出 从 last 平台
10 D
S
串行 数据 输入
11, 12, 13, 14, 3, 4, 5, 6 D
0
至 d
7
并行的 数据 输入
15 CE
时钟 使能 输入
(起作用的 低)
16 V
CC
积极的 供应 电压
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