ADC12441CIJ_集成电路资料查询网

20 函数的 描述
(持续)
数字的 控制 输入
AD 函数
CS WR RD CAL AZ

1 1 1 开始 转换 没有 自动-零

1

1 1 读 转换 结果 没有 自动-零

1 1 0 开始 转换 和 自动-零

1

1 0 读 转换 结果 和 自动-零
1XX

X 开始 校准 循环
0 X 1 0 X 测试 模式 (db2 DB3 DB5 和 DB6 变为 起作用的)
图示 1 函数 的 这 AD 控制 输入
这 表格 在
图示 1
summarizes 这 效应 的 这 数字的
控制 输入 在 这 函数 的 这 ADC12441 这 测试
Mode 在哪里 RD
是 高 和 CS 和 CAL 是 low 是 使用
在 制造 至 thoroughly 审查 输出 这 运作 的
这 ADC12441 小心 应当 是 带去 不 至 无意地
是 在 这个 mode 自从 DB2 DB3 DB5 和 DB6 变为
起作用的 outputs 这个 将 导致 数据 总线 contention
22 RESETTING 这 AD
所有 内部的 逻辑 能 是 reset 这个 将 abort 任何 变换器-
sion 在 process 这 AD 是 重置 whenever 一个 新 变换器-
sion 是 started 用 带去 CS
和 WR low 如果 这个 是 完毕 当
这 相似物 输入 是 正在 抽样 或者 当 EOC 是 low 这
自动-cal 纠正 factors 将 是 corrupted 因此 re-
quiring 一个 自动-cal 循环 在之前 这 next conversion 这个 是
真实 和 或者 没有 自动-zero 这 校准 循环 不能
是 重置 once started 在 电源-向上 这 ADC12441 自动-
matically 变得 通过 一个 校准 循环 那 takes typi-
cally 1396 时钟 cycles 为 reasons 那 将 是 discussed
在 部分 37 一个 新 校准 循环 needs 至 是 started
之后 这 completion 的 这 自动 one
30 相似物 仔细考虑
31 涉及 电压
这 电压 应用 至 这 涉及 输入 的 这 转换器
定义 这 电压 span 的 这 相似物 输入 (这 区别
在 V
在
和 agnd) 在 这个 4095 积极的 输出
代号 和 4096 负的 输出 代号 exist 这 一个-至-d
能 是 使用 在 也 比率计 或者 绝对 涉及 ap-
plications 这 电压 源 驱动 V
REF
必须 有 一个
非常 低 输出 阻抗 和 非常 低 noise 这 电路 在
图示 2a
是 一个 例子 的 一个 非常 稳固的 涉及 那 是
适合的 为 使用 和 这 ADC12441 这 简单的 谈及-
ence 电路 的
图示 2b
将 是 使用 当 这 应用
做 不 需要 低 全部 规模 errors
在 一个 比率计 system 这 相似物 输入 电压 是 propor-
tional 至 这 电压 使用 为 这 AD reference 当 这个
电压 是 这 系统 电源 supply 这 V
REF
管脚 能 是
系 至 V
CC
 这个 技巧 relaxes 这 稳固 必要条件
的 这 系统 涉及 作 这 相似物 输入 和 AD 谈及-
ence move 一起 维持 这 一样 输出 代号 为
给 输入 condition
TLH11017–19

Tantalum

陶瓷的
图示 2a 低 逐渐变化 极其 稳固的 涉及 电路
TLH11017–20
Errors 没有 任何 trims
25

C
b
40

Cto
一个
85

C
全部 规模
g
0075%
g
02%
零
g
0024%
g
0024%
线性
g

LSB
g

LSB
图示 2b 简单的 涉及 电路
11

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20 函数的描述 (持续) 数字的控制输入 AD 函数 CS WR RD CAL AZ  1 1 1 开始转换没有自动-零  1  1 1 读转换结果没有自动-零  1 1 0 开始转换和自动-零  1  1 0 读转换结果和自动-零 1XX  X 开始校准循环 0 X 1 0 X 测试模式 (db2 DB3 DB5 和 DB6 变为起作用的) 图示 1 函数的这 AD 控制输入这表格在图示 1 summarizes 这效应的这数字的控制输入在这函数的这 ADC12441 这测试 Mode 在哪里 RD 是高和 CS 和 CAL 是 low 是使用在制造至 thoroughly 审查输出这运作的这 ADC12441 小心应当是带去不至无意地是在这个 mode 自从 DB2 DB3 DB5 和 DB6 变为起作用的 outputs 这个将导致数据总线 contention 22 RESETTING 这 AD 所有内部的逻辑能是 reset 这个将 abort 任何变换器- sion 在 process 这 AD 是重置 whenever 一个新变换器- sion 是 started 用带去 CS 和 WR low 如果这个是完毕当这相似物输入是正在抽样或者当 EOC 是 low 这自动-cal 纠正 factors 将是 corrupted 因此 re- quiring 一个自动-cal 循环在之前这 next conversion 这个是真实和或者没有自动-zero 这校准循环不能是重置 once started 在电源-向上这 ADC12441 自动- matically 变得通过一个校准循环那 takes typi- cally 1396 时钟 cycles 为 reasons 那将是 discussed 在部分 37 一个新校准循环 needs 至是 started 之后这 completion 的这自动 one 30 相似物仔细考虑 31 涉及电压这电压应用至这涉及输入的这转换器定义这电压 span 的这相似物输入 (这区别在 V 在和 agnd) 在这个 4095 积极的输出代号和 4096 负的输出代号 exist 这一个-至-d 能是使用在也比率计或者绝对涉及 ap- plications 这电压源驱动 V REF 必须有一个非常低输出阻抗和非常低 noise 这电路在图示 2a 是一个例子的一个非常稳固的涉及那是适合的为使用和这 ADC12441 这简单的谈及- ence 电路的图示 2b 将是使用当这应用做不需要低全部规模 errors 在一个比率计 system 这相似物输入电压是 propor- tional 至这电压使用为这 AD reference 当这个电压是这系统电源 supply 这 V REF 管脚能是系至 V CC  这个技巧 relaxes 这稳固必要条件的这系统涉及作这相似物输入和 AD 谈及- ence move 一起维持这一样输出代号为给输入 condition TLH11017–19  Tantalum  陶瓷的图示 2a 低逐渐变化极其稳固的涉及电路 TLH11017–20 Errors 没有任何 trims 25  C b 40  Cto 一个 85  C 全部规模 g 0075% g 02% 零 g 0024% g 0024% 线性 g  LSB g  LSB 图示 2b 简单的涉及电路 11

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