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资料编号:990076
 
资料名称:ICS93705
 
文件大小: 65K
   
说明
 
介绍:
DDR Phase Lock Loop Zero Delay Clock Buffer
 
 


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ICS93705
0418c—08/08 /02
绝对 最大 比率
供应 电压 (vdd &放大; avdd). . . . . . . . . . . -0.5v 至 3.6v
逻辑 输入 . . . . . . . . . . . . . . . . . . . . . . . . . 地 –0.5 v 至 v
DD
+0.5 v
包围的 运行 温度 . . . . . . . . . . 0°c 至 +85°c
存储 温度 . . . . . . . . . . . . . . . . . . . –65°c 至 +150°c
压力 在之上 那些 列表 下面
绝对 最大 比率
将 导致 永久的 损坏 至 这 设备. 这些
比率 是 压力 规格 仅有的 和 函数的 运作 的 这 设备 在 这些 或者 任何 其它 情况 在之上 那些
列表 在 这 运算的 sections 的 这 规格 是 不 暗指. 暴露 至 绝对 最大 比率 情况
为 扩展 时期 将 影响 产品 可靠性.
电的 特性 - 输入 / 供应 / 一般 输出 参数
T
一个
=0 - 70°c; 供应 voltage v
DD
= 2.5 v +/-0.2V(除非otherwise stated)
PA内存ETER SYMBOL CONDITIONS MIN 典型值 毫安X UNITS
输入 高 电流 I
IH
V
I
= v
DD
或者 地
µ
一个
输入 低 电流 I
IL
V
I
= v
DD
或者 地
µ
一个
I
dd2.5
C
L
=0 pf 在 133 mhz 245 300 毫安
I
DDPD
C
L
=0 pf 100
µ
一个
输出放 高 电流 I
OH
V
DD
=2.3v, v
输出
= 1v -43 -18 毫安
输出放 高 电流 I
OL
V
DD
=2.3v, v
输出
= 1.2V 26 43 毫安
高 impedance 输出
电流
I
OZ
V
DD
=2.7v, v
输出
= v
DD
或者 地 10
µ
一个
输入 clamp voltage V
IK
iin =-18 毫安; V
V
DD
= 最小值 至 最大值, i
OH
= -1ma 2.1 2.42 V
V
DD
=2.3v, i
OH
= -12ma 1.87 V
V
OL
V
DD
= 最小值 至 最大值, i
OH
= 1ma 0.04 0.1 V
V
DD
=2.3v, i
OH
= 12ma 0.35 0.6 V
InputCapacance
1
C
V
I
= v
DD
或者 地 pF
输出Capacitance
1
C
输出
V
I
= v
DD
或者 地 3 pF
1
有保证的 用design,100%tested 在 产品ion.
Operating supply电流
V
OH
低-level 输出Voltage
High-level 输出电压
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