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资料编号:1012597
 
资料名称:M48T18-100PC1TR
 
文件大小: 471K
   
说明
 
介绍:
64 Kbit 8Kb x 8 TIMEKEEPER SRAM
 
 


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m48t08, m48t08y, m48t18
写 模式
这 m48t08/18/08y 是 在 这 写 模式 当-
总是 w
, e1, 和 e2 是 起作用的. 这 开始 的 一个
写 是 关联 从 这 latter occurring 下降-
ing 边缘 的 w
或者 e1, 或者 这 rising 边缘 的 e2. 一个
写 是 terminated 用 这 早期 rising 边缘 的
W
或者 e1, 或者 这 falling 边缘 的 e2. 这 地址
必须 是 使保持 有效的 throughout the 循环. e1
或者 w
必须 返回 高 或者 e2 低 为 一个 最小 的 t
E1HAX
或者 t
E2LAX
从 碎片 使能 或者 t
WHAX
从 写
使能 较早的 至 这 initiation 的 另一 读 或者
写 循环. 数据-在 必须 是 有效的 t
DVWH
较早的 至
这 终止 的 写 和 仍然是 有效的 为 t
WHDX
af-
terward. g
应当 是 保持 高 在 写 cy-
cles 至 避免 总线 contention; 不管怎样, 如果 这 输出
总线 有 被 使活动 用 一个 低 在 e1
和 g
一个 高 在 e2, 一个 低 在 w
将 使不能运转 这 输出
t
WLQZ
之后 wfalls.
图示 8. 写 使能 控制, 写 交流 波形
AI00963
tAVAV
tWHAX
tDVWH
数据 输入
a0-a12
E1
W
dq0-dq7
有效的
E2
tAVWH
tAVE1L
tAVE2H
tWLWH
tAVWL
tWLQZ
tWHDX
tWHQX
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