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管脚 描述
vin -
供应 电压 为 这 ic. 它 是 推荐 至 放置 一个
1µf 解耦 电容 作 关闭 作 可能 至 这 ic.
地
- 小 信号 地面 为 这 pwm 控制 平台. 所有
内部的 控制 电路 是 关联 至 这个 管脚.
pg -
这 电源 好的 是 一个 打开-流 输出. 一个 拉-向上
电阻 应当 是 连接 在 pg 和 vin. 它 是
asserted 起作用的 高 当 这 输出 电压 reaches
94.5% 的 这 名义上的 值.
fb -
这 反馈 管脚 是 使用 至 sense 这 输出 电压,
和 应当 是 连接 至 vout 为 正常的 运作.
vset -
这个 管脚 是 使用 至 程序 这 输出 电压.
谈及 至 表格 1 在下 为 详细信息.
同步 -
这个 管脚 是 使用 为 同步. 这 转换器
切换 频率 能 是 同步 至 一个 外部
cmos 时钟 信号 在 这 范围 的 (500khz 至 1mhz).
en -
一个 逻辑 高 使能 这 转换器, 逻辑 低 forces 这
设备 在 关闭 模式 减少 这 供应 电流 至
较少 比 10
µ
一个 在 25°c. 这个 管脚 应当 是 牵引的 向上 至 vcc
通过 一个 10k 电阻.
l -
这个 管脚 是 这 流 接合面 的 这 内部的 电源
mosfets 和 是 至 是 连接 至 这 外部 inductor.
pgnd -
电源 地面. 连接 所有 电源 grounds 至 这个 管脚.
pvcc -
这个 管脚 提供 这 输入 供应 为 这 内部的
mosfets. 它 是 推荐 至 放置 一个 1µf 解耦
电容 作 关闭 作 可能 至 这 ic.
ct -
定时 电容 连接 至 设置 这 25ms 最小
脉冲波 宽度 为 这 重置
信号.
重置-
这 输出 的 这 重置 supervisory 电路, 这个
monitors vin. 这 ic asserts 这些 重置
信号
whenever 这 供应 电压 drops 在下 一个 preset 门槛
和 keeps 它 asserted 为 在 least 25ms 之后 vcc (vin) 有
risen 在之上 这 重置 门槛. 这些 输出 是 推-
拉. 重置
是 低 当 re-设置 这 微处理器.
这 pwm 将 continue 至 operate 直到 vin drops 在下 这
uvlo 门槛.
函数的 描述
这 isl6410, isl6410a 是 一个 同步的 buck 调整器
和 整体的 n- 和 p-频道 电源 场效应晶体管 和
提供 前-设置 管脚 可编程序的 输出. 同步的
整流 和 内部的 mosfets 是 使用 至 达到 高等级的
效率 和 减少 号码 的 外部 组件.
运行 频率 的 750khz典型 准许 这 使用 的
小 inductor 和 电容 值. 这 设备 能 是
同步 至 一个 外部 时钟 信号 在 这 范围 的
500khz 至 1mhz. 这 pg 输出 indicates 丧失 的 规章制度
在 pwm 输出.
这 pwm 是 为基础 在 这 顶峰 电流 模式 控制
topology 和 内部的 斜度 compensation. 在 这 beginning
的 各自 时钟 循环, 这 高 一侧 p-频道 场效应晶体管 是
转变 在. 这 电流 在 这 inductor ramps 向上 和 是
sensed 通过 一个 内部的 电路. 在 exceeding 一个 preset 限制 这
高 一侧 转变 是 转变 止 造成 这 pwm 比较器
至 trip. 这个 occurs whenever 这 输出 电压 是 在
规章制度 或者 当 这 inductor 电流 reaches 这 电流
限制. 之后 一个 最小 dead 时间 至 阻止 shoot 通过
电流, 这 低 一侧 n-频道 场效应晶体管 转变 在 和 这
电流 ramps 向下. 作 这 clock 循环 是 完成, 这 低
一侧 转变 转变 止 和 the next 时钟 循环 是 initiated.
这 控制 循环 是 内部补偿 因此 减少 这
数量 的 外部 组件.
这 转变 电流 是 内部 sensed 和 这 最大
电流 限制 是 1300ma 顶峰.
同步
这 典型 运行 频率 为 这 转换器 是 750khz.
它 是 可能 至 同步 这 转换器 至 一个 外部
时钟 频率 在 这 范围 的 500khz 至 1000khz 当 一个
外部 信号 是 应用 至 同步 管脚. 这 设备 将
automatically 发现 和 同步 至 这 rising 边缘 的
这 第一 时钟 脉冲波. 如果 这时钟 信号 是 stopped, 这
转换器 automatically switches 后面的 至 这 内部的 时钟
和 持续 它的 运作 没有 中断. 这 转变
在 将 是 initiated 如果 非 rising 边缘 triggers 是 呈现 在
这 同步 管脚 为 一个 持续时间 的 四 时钟 循环.
软-开始
作 这 en (使能) 管脚 变得 高, 这 软-开始 函数 将
发生 一个 内部的 电压 ramp. 这个 导致 这 开始-向上
电流 至 慢速地 上升 preventing 输出 电压 越过
和 高 inrush 电流. 这 软-开始 持续时间 是 典型地
5.5ms 和 750khz 切换 frequency. 当 这 软-开始
是 完成, 这 错误 放大器 将 是 连接 直接地 至
这 内部的 电压 涉及.
使能
逻辑 低 在 en 管脚 forces 这 pwm 部分 在 关闭.
在 这 关闭 模式 所有 这 主要的 blocks 的 这 pwm
包含 电源 switches, 驱动器, 电压 涉及, 和
振荡器 是 转变 止.
欠压 lockout
一个 欠压 lockout 电路 阻止 这 转换器 从
turning 在 当 这 电压 在 vin 是 较少 比 这 值
指定 在 这 输入 uvlo 门槛 部分 的 这
电的 规格.
TABLE1.
VSET
ISL6410
Vo
ISL6410A
Vo
高 1.8v 3.3v
打开 (nc) 1.5v 1.8v
低 1.2v 1.2v
isl6410, isl6410a
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