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资料编号:1015404
 
资料名称:MAX1242AESA
 
文件大小: 158K
   
说明
 
介绍:
+2.7V to %.25V, Low-Power, 10-Bit Serial ADCs in SO-8
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
max1242/max1243
+2.7v 至 +5.25v, 低-电源, 10-位
串行 adcs 在 所以-8
4 _______________________________________________________________________________________
定时 特性
(v
DD
= +2.7v 至 +5.25v, 电路 的 图示 9, t
一个
= t
最小值
至 t
最大值
, 除非 否则 指出.)
便条 1:
测试 在 v
DD
= +2.7v.
便条 2:
相关的 精度 是 这 背离 的 这 相似物 值 在 任何 代号 从 它的 theoretical 值 之后 这 全部-规模 范围 和
补偿 有 被 校准.
便条 3:
补偿 nulled.
便条 4:
样本 测试 至 0.1% aql.
便条 5:
外部 加载 应当 不 改变 在 转换 为 指定 精度.
便条 6:
有保证的 用 设计. 不 主题 至 生产 测试.
便条 7:
量过的 作 [v
FS
(v
DD
(最小值)
) - v
FS
(v
DD
(最大值)
)].
便条 8:
至 保证 acquisition 时间, t
ACQ
是 这 最大 时间 这 设备 takes 至 acquire 这 信号, 和 是 也 这 最小
时间 需要 为 这 信号 至 是 acquired.
DOUT DOUT
6k
DGND
C
加载
= 50pf C
加载
= 50pf
6k
DGND
+2.7v
b)
高-z 至 v
OL
和 v
OH
至 v
OL
一个)
高-z 至 v
OH
和 v
OL
至 v
OH
DOUT
DOUT
6k
DGND
C
加载
= 50pf C
加载
= 50pf
6k
DGND
+2.7v
b)
V
OL
至 高-z
一个)
V
OH
至 高-z
图示 1. 加载 电路 为 dout 使能 时间
图示 2. 加载 电路 为 dout 使不能运转 时间
max124_ _m
max124_ _c/e
图示 1, c
加载
= 50pf
图示 1,
C
加载
= 50pf
CS
= v
DD
(便条 8)
图示 2, c
加载
= 50pf
情况
ns240t
DV
CS
下降 至 输出 使能
ns
20 200
t
µs1.5t
ACQ
acquisition 时间
sclk 下降 至 输出 数据 有效的
ns240t
CS
CS
脉冲波 宽度
ns0t
STR
dout 上升 至 sclk 上升 (便条 6)
ns50t
CS0
sclk 低 至
CS
下降 建制 时间
ns240t
TR
CS
上升 至 输出 使不能运转
MHz0 2.1f
SCLK
sclk 时钟 频率
ns200t
CH
sclk 脉冲波 宽度 高
ns200t
CL
sclk 脉冲波 宽度 低
UNITSMIN 典型值 最大值
SYMBOLPARAMETER
20 240
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