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资料编号:1017709
 
资料名称:MAX5480BCEE
 
文件大小: 64K
   
说明
 
介绍:
8-Bit Parallel DAC in QSOP-16 Package
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
MAX5480
_______________详细地 描述
这 max5480 是 一个 8-位 乘以 数字的-至-相似物
转换器 (dac) 那 组成 的 一个 薄的-影片 r-2r 电阻
排列 和 cmos 电流 steering switches. 图示 3
显示 一个 simplified 图式 的 这 dac. 这 inverted
r-2r ladder divides 这 电压 或者 电流 涉及 在
一个 二进制的 manner among 这 第八 steering switches.
这 巨大 的 这 电流 appearing 在 也 输出
终端 取决于 在 这 号码 的 switches 选择;
因此, 这 输出 是 一个 相似物 描述 的 这
数字的 输入. 这 二 输出 terminals 必须 是 使保持 在 这
一样 潜在的 所以 一个 常量 电流 是 maintained 在
各自 ladder leg. 这个 制造 这 ref 输入 电流 inde-
pendent 的 转变 状态 和 也 确保 那 这
max5480 维持 它的 极好的 线性 效能.
接口-逻辑 信息
模式 选择
这 输入
CS
WR
控制 这 max5480’s operat-
ing 模式 (看 表格 1).
写 模式
CS
WR
是 两个都 低, 这 max5480 是 在 写
模式, 和 它的 相似物 输出 responds 至 数据 activity 在
这 d0–d7 数据-总线 输入. 在 这个 模式, 这 数据
latches 是 transparent (看 tables 2 和 3).
支撑 模式
在 支撑 模式, 这 max5480 retains 这 数据 那 是
呈现 在 d0–d7 just 较早的 至
CS
或者
WR
假设 一个
高 状态. 这 相似物 输出 仍然是 在 这 值 cor-
responding 至 这 数字的 代号 锁 在 这 数据 获得.
__________产品 信息
使用 这 max5480 在 电压-
输出 模式 (单独的 供应)
这 max5480 能 是 使用 也 作 一个 电流-输出
dac (计算数量 1 和 6) 或者 作 一个 电压-输出 dac
(计算数量 2 和 5).
至 使用 这 max5480 在 电压 模式, 连接 out1 至
这 涉及 输入 和 连接 out2 至 地面. ref,
now 这 dac 输出, 是 一个 电压 源 和 一个 con-
stant 输出 阻抗 的 10k
(nominally). 这个 输出
是 常常 缓冲 和 一个 运算 放大 (图示 5).
一个 有利因素 的 电压-模式 运作 是 单独的-
供应 运作 为 这 完全 电路; i.e., 一个 nega-
tive 涉及 是 不 必需的 为 一个 积极的 输出. 它 是
重要的 至 便条 那 这 范围 的 这 涉及 是
restricted 在 电压 模式. 这 涉及 输入 (电压
在 out1) 必须 总是 是 积极的 和 是 限制 至 非
更多 比 v
DD
- 3v. 如果 这 涉及 电压 超过
这个 值, 线性 是 degraded.
8-位 并行的 dac 在
qsop-16 包装
4 _______________________________________________________________________________________
WR
L L
H
X
X
H
CS
MAX5480
10pF
V
输出
16
14
15
V
REF
V
DD
R2
1k
R1
2k
D7–D0
CS
OUT1
12
数据
输入
4–11
13
OUT2
1
2
WR
r1 和 r2 使用 仅有的 如果 增益
调整 是 必需的.
REF
R
FB
3
V
DD
MAX4330
图示 1. 单极的 二进制的 运作 (二-quadrant multiplication)
MAX5480
REF
INPUT*
输出
电压
(10k
输出
阻抗)
OUT1 REF
14
15
1
2
16
13 12 3
OUT2
RFB V
DD
+5V
D7–D0
4–11
数据 在
CSWR
*(v
DD
- 3v, 最大值)
图示 2. 典型 运行 电路 (电压 mode—unbuffered)
模式
支撑
支撑
dac 回馈
dac responds 至 数据 总线
(d0–d7) 输入.
数据 总线 (d0–d7) 是 锁 输出;
dac holds last 数据 呈现
CS
或者
WR
assumed 高
状态.
表格 1. 模式-选择 表格
l = 低 状态, h = 高 状态, x = don’t 小心
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