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资料编号:1020876
 
资料名称:MC100LVEL14DW
 
文件大小: 85K
   
说明
 
介绍:
1:5 Clock Distribution Chip
 
 


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MOTOROLA
半导体 技术的 数据
4–1
rev 1
motorola, 公司 1996
7/95
1:5 时钟 分发 碎片
这 mc100lvel/100el14 是 一个 低 skew 1:5 时钟 分发 碎片
设计 explicitly 为 低 skew 时钟 分发 产品. 这
设备 能 是 驱动 用 也 一个 差别的 或者 单独的-结束 ecl 或者, 如果
积极的 电源 供应 是 使用, pecl 输入 信号. 这 lvel14 是
functionally 和 管脚 兼容 和 这 el14 但是 是 设计 至 运作
在 ecl 或者 pecl 模式 为 一个 电压 供应 范围 的 –3.0v 至 –3.8v ( 或者
输出 应当
是 连接 至 这 clk
输入 和 绕过 至 地面 通过 一个 0.01
µ
F
电容. 这 v
BB
输出 是 设计 至 act 作 这 切换 涉及
为 这 输入 的 这 lvel14 下面 单独的-结束 输入 情况, 作 一个
结果 这个 管脚 能 仅有的 源/下沉 向上 至 0.5ma 的 电流.
这 lvel14 特性 一个 多路复用 时钟 输入 至 准许 为 这
分发 的 一个 更小的 速 scan 或者 测试 时钟 along 和 这 高 速
系统 时钟. 当 低 (或者 left 打开 和 牵引的 低 用 这 输入
pulldown 电阻) 这 sel 管脚 将 选择 这 差别的 时钟 输入.
这 一般 使能 (en
) 是 同步的 所以 那 这 输出 将 仅有的
是 使能/无能 当 它们 是 already 在 这 低 状态. 这个 避免
任何 chance 的 generating 一个 runt 时钟 脉冲波 当 这 设备 是
使能/无能 作 能 发生 和 一个 异步的 控制. 这
内部的 flip flop 是 clocked 在 这 下落 边缘 的 这 输入 时钟, 因此
所有 有关联的 规格 限制 是 关联 至 这 负的 边缘 的
这 时钟 输入.
50ps 输出-至-输出 skew
同步的 使能/使不能运转
多路复用 时钟 输入
75k
内部的 输入 pulldown 电阻器
>2000v 静电释放 保护
V
EE
范围 的 –3.0v 至 –5.5v
逻辑 图解 和 引脚 分派
Q1 Q2 Q3 Q4
1718 16 15 14 13 12
43
56789
V
CC
11
10
Q4Q3
Q2Q1
NC SCLK
CLK CLK V
BB
SEL V
EE
D
Q
1 0
Q0
1920
21
V
CC
Q0
EN
MC100LVEL14
MC100EL14
dw 后缀
塑料 soic 包装
情况 751d-04
1
20
管脚 函数
CLK diff 时钟 输入
SCLK scan 时钟 输入
EN
同步 使能
SEL 时钟 选择 输入
V
BB
涉及 输出
Q
0–4
diff 时钟 输出
管脚 描述
CLK
L
H
X
X
X
SCLK
X
X
L
H
X
SEL
L
L
H
H
X
EN
L
L
L
L
H
Q
L
H
L
H
L*
函数 表格
* 在 next 负的 转变 的
clk 或者 sclk
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