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资料编号:1021216
 
资料名称:MC14569BDW
 
文件大小: 323K
   
说明
 
介绍:
Programmable Divide-By-N Dual 4-Bit Binary/BCD Down Counter
 
 


: 点此下载
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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
MC14569B
http://onsemi.com
6
管脚 描述
输入
p0, p1, p2, p3 (管脚 3, 4, 5, 6)
— preset 输入.
可编程序的 输入 为 这 least 重大的 计数器. 将
是 二进制的 或者 bcd 取决于 在 这 控制 输入.
p4, p5, p6, p7 (管脚 11, 12, 13, 14)
preset 输入.
可编程序的 输入 为 这 大多数 重大的 计数器. 将
是 二进制的 或者 bcd 取决于 在 这 控制 输入.
时钟 (管脚 9)
— preset 数据 是 decremented 用 一个 在
各自 积极的 转变 的 这个 信号.
输出
零 发现 (管脚 1)
— 这个 输出 是 正常情况下 低 和
变得 高 为 一个 时钟 循环 当 这 计数器 有
decremented 至 零.
q (管脚 15)
— 输出 的 这 last 平台 的 这 大多数
重大的 计数器. 这个 输出 将 是 inactive 除非 这
preset 输入 p7 有 被 设置 高.
控制
cascade 反馈 (管脚 7)
— 这个 管脚 是 正常情况下 设置
高. 当 低, 加载 的 这 preset 输入 (p0 通过 p7)
是 inhibited, i.e., p0 通过 p7 是 “don’t cares.” 谈及 至
表格 1 为 输出 特性.
CTL
1
(管脚 2)
— 这个 管脚 控制 这 counting 模式 的
这 least 重大的 计数器. 当 设置 高, counting 模式
是 bcd. 当 设置 低, counting 模式 是 二进制的.
CTL
2
(管脚 10)
— 这个 管脚 控制 这 counting 模式 的
这 大多数 重大的 计数器. 当 设置 高, counting 模式
是 bcd. 当 设置 低, counting 模式 是 二进制的.
供应 管脚
V
SS
(管脚 18)
— 负的 供应 电压. 这个 管脚 是
通常地 连接 至 地面.
V
DD
(管脚 16)
— 积极的 供应 电压. 这个 管脚 是
连接 至 一个 积极的 供应 电压 ranging 从 3.0
伏特 至 18.0 伏特.
运行 特性
这 mc14569b 是 一个 可编程序的 divide–by–n 双
4–bit 向下 计数器. 这个 计数器 将 是 编写程序 (i.e.,
preset) 在 bcd 或者 二进制的 代号 通过 输入 p0 至 p7. 为
各自 计数器, 这 counting sequence 将 是 选择
independently 用 应用 一个 高 (为 bcd 计数) 或者 一个 低
(为 二进制的 计数) 至 这 控制 输入 ctl
1
和 ctl
2
.
这 分隔 比率 n (n 正在 这 值 编写程序 在 这
preset 输入 p0 至 p7) 是 automatically 承载 在 这
计数器 作 soon 作 这 计数 1 是 发现. 因此, 一个
分隔 比率 的 一个 是 不 可能. 之后 n 时钟 循环,
一个 脉冲波 呈现 在 这 零 发现 输出. (看 定时
图解.) 这 q 输出 是 这 输出 的 这 last 平台 的 这
大多数 重大的 计数器 (看 tables 1 通过 5, 模式
控制.)
当 cascading 这 mc14569b 至 这 mc14526b, 这
cascade 反馈 输入, q, 和 零 发现 输出 必须
是 各自 连接 至 “0”, 时钟, 和 加载 的 这
下列的 计数器. 如果 这 mc14569b 是 使用 alone, cascade
反馈 必须 是 连接 至 v
DD
.
18
16
14
12
10
8.0
6.0
4.0
2.0
0
+ 100+80+60+40+200–20–40
T
一个
, 包围的 温度 (
°
c)
f, 频率 (mhz), 典型
C
L
= 50 pf
V
DD
= 15 v
10 v
5.0 v
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