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资料编号:1033104
 
资料名称:MT8920BE
 
文件大小: 534K
   
说明
 
介绍:
ISO-CMOS ST-BUS⑩ FAMILY ST-BUS Parallel Access Circuit
 
 


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MT8920B
CMOS
3-10
定时 信息 为 数据 transfers 在 这个 接口
是 显示 在 图示 14. 这 模式 1 接口 是
设计 至 运作 直接地 和 一个 68000-类型
异步的 总线 但是 能 容易地 accommodate 大多数
其它 popular 微处理器 作 好.
控制 寄存器
二 控制 寄存器 准许 控制 的 模式 1
特性. 控制 寄存器 1 提供 位 至 选择
这 类型 的 中断, 至 使能 中断 从 二
不同的 和 独立 来源 和 至 重置 这
中断 寄存器. 也 包含 在 控制
寄存器 1 是 位 至 configure 这 设备 为 24 或者
32 频道 运作 和 至 expand 这 地址
范围 为 便利的 进入 至 这 第二 transmit
内存 tx1. 一个 描述 的 这 位 功能 在
控制 寄存器 1 是 显示 在 表格 3.
模式 1 提供 各种各样的 loopback paths 和 输出
configuration 选项 这个 是 控制 用 位 在
控制 寄存器 2. 位 d
0
, d
1
的 控制 寄存器 2
configure loopbacks 使用 输入 和 输出 streams
sti0, sto0 作 描述 在 表格 4. 这 输入
stream sti0 能 是 looped 后面的 至 源 这 输出
stream sto0 作 好 作 receive 内存 rx0. 这
transmit 内存 tx0 能 是 looped 至 源 这
receive 内存 rx0, 作 好 作 sto0 和, 这 transmit
内存 tx0 能 是 looped 至 这 receive 内存 rx0
当 sti0 来源 sto0. 这 函数 的 这些
loopback configurations 是 显示 在 图示 5.
在 一个 类似的 方法, 这 输出 sto1 能 是 reconfigured
为 不同的 符合实际. 位 d
2
和 d
3
的 控制
寄存器 2 准许 sto1 至 是 sourced, 和 一个 一个
框架 延迟 通过 tx1 从 receive stream sti0. sto1
能 也 输出 这 结果 的 一个 comparison 的 这
内容 的 tx1 内存 和 输入 stream sti0. 这些
输出 configurations 的 sto1 是 显示 在 图示 6
一个 和 b. 图示 6 c 显示 这 效应 的 结合
这些 二 特性.
中断 寄存器
中断 能 是 发生 在 模式 1 仅有的. 二
途径 的 这 st-总线 输入 stream, sti0, 能 是
选择 至 提供 一个 中断 至 这 系统.
中断 能 是 的 二 类型: 静态的 或者 动态.
静态的 中断 是 造成 当 数据 在里面 一个
选择 频道 matches 一个 给 模式. 动态
中断 出现 当 位 在 一个 选择 频道
改变 状态 (1 至 0, 0 至 1 或者 toggle). 中断 是
控制 通过 二 完全同样的 paths (1 和 2)
consisting 的 这 下列的 寄存器:
中断 频道 地址 (1/2):
这 地址
(0-31) 的 这 频道 这个 将 发生 这
中断 是 贮存 在 这个 寄存器.
image 寄存器 (1/2):
这 内容 的 这
频道 造成 这 中断 是 贮存 在 这个
寄存器. 读 这个 寄存器 将 clear 它的 内容.
相一致 字节 寄存器 (1/2):
在 静态的 模式 这个
寄存器 是 使用 至 store 这 字节 这个 将 是
对照的 和 这 内容 的 这 选择 频道
造成 这 中断.
在 动态 模式, 这 位 在 这个 寄存器 和 这
相应的 位 在 这 中断 掩饰 寄存器
define 这 类型 的 动态 中断 (i.e., 0 至 1, 1 至
0, toggle). (谈及 至 表格 5.)
表格 4. 控制 寄存器 2 位 definitions
名字 描述
7-4 (unused)
3-2 CONFIG
sto1 输出 configuration 位:
D
3
D
2
= 00- 正常的 运作. st-总线 stream 从 tx1 是 输出 在 sto1 管脚.
01- sti0 stream 是 输出 在 sto1 管脚 delayed 一个 框架 (图示 6 一个).
10- sti0 是 对照的 通过 xor (独有的 或者) 和 st-总线 stream
从 tx1 和 输出 在 sto1 (图示 6 b).
11- sti0 stream, delayed 一个 框架 (通过 tx1), 是 对照的 (xor) 和 这
next 框架 arriving 在 sti0 和 这 结果 输出 在 sto1 (图示 6 c).
1-0 LOOPBACK
内部的 loopback configuration 位:
D
1
D
0
= 00- 正常的 运作. 非 内部的 循环.
01- 循环 sti0 至 sto0 当 安静的 接到 sti0 在 rx0 (图示 5 一个).
10- 循环 tx0 输出 st-总线 stream 至 rx0 输入 st-总线 stream 当
outputting tx0 输出 至 sto0. sti0 是 不 received (图示 5 b).
11- 循环 tx0 输出 st-总线 stream 至 rx0 输入 st-总线 stream. 循环
sti0 至 sto0 (图示 5 c).
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