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资料编号:1044514
 
资料名称:SN74LVC16374ADGGR
 
文件大小: 334K
   
说明
 
介绍:
16 BIT EDGE TRIGGERED D TYPE FLIP FLOP WITH 3 STATE OUTPUTS
 
 


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scas663d −march 2001 − 修订 8月 2003
2
邮递 办公室 盒 655303
达拉斯市, 德州 75265
描述/订货 信息
OE做 不 affect 内部的 行动 的 这 flip-flop. old 数据 能 是 retained 或者 新 数据 能 是 entered 当
这 输出 是 在 这 高-阻抗 状态.
至 确保 这 高-阻抗 状态 在 电源 向上 或者 电源 向下, oe
应当 是 系 至 v
CC
通过 一个 pullup
电阻; 这 最小 值 的 这 电阻 是 决定 用 这 电流-sinking 能力 的 这 驱动器.
输入能 是 驱动 从 也 3.3-v 或者 5-v 设备. 这个 特性 准许 这 使用 的 这个 设备 作 一个 翻译
在 一个 mixed 3.3-v/5-v 系统 环境.
这个设备 是 全部地 指定 为 partial-电源-向下 产品 使用 i
. 这 i
电路系统 使不能运转 这 输出,
阻止 损害的 电流 backflow 通过 这 设备 当 它 是 powered 向下.
终端 assignments
123456
一个
1OE NC NC NC NC 1CLK
B
1Q2 1Q1 1D1 1D2
C
1Q4 1Q3 V
CC
V
CC
1D3 1D4
D
1Q6 1Q5 1D5 1D6
E
1Q8 1Q7 1D7 1D8
F
2Q1 2Q2 2D2 2D1
G
2Q3 2Q4 2D4 2D3
H
2Q5 2Q6 V
CC
V
CC
2D6 2D5
J
2Q7 2Q8 2D8 2D7
K
2OE NC NC NC NC 2CLK
nc − 非 内部的 连接
函数 表格
(各自 flip-flop)
输入
输出
OE
CLK D
输出
Q
L
H H
L
LL
L h 或者 l X Q
0
H X X Z
逻辑 图解 (积极的 逻辑)
1OE
1CLK
1D1
至 七 其它 途径
1Q1
2OE
2CLK
2D1
2Q1
至 七 其它 途径
1
48
47
24
25
36
C1
1D
132
C1
1D
管脚 号码 显示 是 为 这 dgg, dgv, 和 dl 包装.
gql 或者 zql 包装
(顶 视图)
一个
B
C
D
E
F
G
H
J
K
123456
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