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资料编号:1048250
 
资料名称:TLC3548IDW
 
文件大小: 790K
   
说明
 
介绍:
5-V ANALOG, 3-/5-V DIGITAL, 14-BIT, 200-KSPS, 4-/8-CHANNELS SERIAL ANALOG-TO-DIGITAL CONVERTERS WITH 0-5 V (PSEUDODIFFERENTIAL) INPUTS
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
tlc3544, tlc3548
5-v 相似物, 3-/5-v 数字的, 14-bit, 200-ksps, 4-/8-channels 串行
相似物-至-数字的 转换器 和 0-5 v (pseudodifferential) 输入
SLAS266C
october 2000
修订 将 2003
13
邮递 办公室 盒 655303
达拉斯市, 德州 75265
定时 (所需的)东西 在 推荐 运行 自由-空气 温度 范围, av
DD
= 5 v,
DV
DD
= 5 v, v
REFP
= 5 v, v
REFM
= 0 v, sclk 频率 = 25 mhz (除非 否则 指出) (持续)
CSTART触发
参数 最小值 典型值 最大值 单位
t
d(12)
延迟 时间, 延迟 从 cstartrising 边缘 至 eoc 下落
边缘, 在 10-pf 加载
0 15 21 ns
t
w(4)
脉冲波 宽度 cstart低 时间: t
w(l)
(cstart), 在 25-pf 加载
t
(样本
ref)
+0.4 便条 7
µ
s
t
d(13)
延迟 时间, 延迟 从 cstartrising 边缘 至 cstart下落
边缘, 在 25-pf 加载
t
(conv)
+15 注释 7 和 8 ns
t
d(14)
延迟 时间, 延迟 从 cstartrising 边缘 至 int下落 边缘,
在 10-pf 加载
t
(conv)
+15 注释 7 和 8 t
(conv)
+21 ns
t
d(15)
延迟 时间, 延迟 从 cstart下落 边缘 至 intrising 边缘,
在 10-pf 加载
0 6
µ
s
注释: 7. 这 脉冲波 宽度 的 cstart必须 是 不 较少 比 这 必需的 抽样 时间. 这 延迟 从 cstartrising 边缘 至 下列的
CSTART
下落 边缘 必须 不 是 较少 比 这 必需的 转换 时间. 这 延迟 从 cstartrising 边缘 至 这 int下落 边缘
是 equal 至 这 转换 时间.
8. 这 最大 比率 的 sclk 是 25 mhz 为 正常的 长 抽样 和 10 mhz 为 正常的 短的 抽样.
t
(conv)
或者
t
w(4)
t
d(13)
t
d(12)
t
d(14)
t
d(15)
CSTART
EOC
INT
扩展 抽样
图示 4. 核心的 定时 为 扩展 抽样 (cstart触发)
详细地 描述
转换器
这 转换器 是 一个 successive-approximation 模数转换器 utilizing 一个 承担 redistribution dac. 图示 5 显示 一个
simplified 块 图解 的 这 模数转换器. 这 抽样 电容 acquires 这 信号 在 ain 在 这 抽样
时期. 当 这 转换 处理 开始, 这 控制 逻辑 directs 这 承担 redistribution dac 至 增加 和
减去 fixed amounts 的 承担 从 这 抽样 电容 至 bring 这 比较器 在 一个 保持平衡 情况.
当 保持平衡, 这 转换 是 完全 和 这 模数转换器 输出 代号 是 发生.
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