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资料编号:1055491
 
资料名称:AD7839
 
文件大小: 169264K
   
说明
 
介绍:
Octal 13-Bit, Parallel Input, Voltage-Output DAC
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
–3–rev. 0
AD7839
(这些 特性 是 包含 为 设计 guidance 和 是 不 主题
至 生产 测试.)
交流 效能 特性
参数 一个 单位 测试 情况/comments
动态 效能
输出 电压 安排好 时间 30
µ
s 典型值 全部-规模 改变 至
±
1/2 lsb. dac 获得 内容 alternately
40
µ
s 最大值 承载 和 所有 0s 和 所有 1s
回转 比率 0.7 v/
µ
s 典型值
数字的-至-相似物 glitch impulse 230 nv-s 典型值 量过的 和 v
REF
(+) = +5 v, v
REF
(–) = –5 v. dac 获得
alternately 承载 和 0fff 十六进制 和 1000 十六进制. 不 依赖
在 加载 情况
频道-至-频道 分开 99 db 典型值 看 terminology
dac-至-dac 串扰 40 nv-s 典型值 看 terminology
数字的 串扰 0.2 nv-s 典型值 feedthrough 至 dac 输出 下面 测试 预定的 至 改变 在 数字的
输入 代号 至 另一 转换器
数字的 feedthrough 0.1 nv-s 典型值 效应 的 输入 总线 activity 在 dac 输出 下面 测试
输出 噪音 谱的 密度
@ 1 khz 200 nv/
Hz
典型值 所有 1s 承载 至 dac. v
REF
(+) = v
REF
(–) = 0 v
规格 主题 至 改变 没有 注意.
定时 规格
1, 2
参数 限制 在 t
最小值,
T
最大值
单位 描述
t
1
15 ns 最小值 地址 至
WR
建制 时间
t
2
0 ns 最小值 地址 至
WR
支撑 时间
t
3
50 ns 最小值
CS
pulsewidth 低
t
4
50 ns 最小值
WR
pulsewidth 低
t
5
0 ns 最小值
CS
WR
建制 时间
t
6
0 ns 最小值
WR
CS
支撑 时间
t
7
20 ns 最小值 数据 建制 时间
t
8
0 ns 最小值 数据 支撑 时间
t
9
30
µ
s 典型值 安排好 时间
t
10
300 ns 最大值
CLR
脉冲波 触发 时间
t
11
50 ns 最小值
LDAC
pulsewidth 低
注释
1
所有 输入 信号 是 指定 和 tr = tf = 5 ns (10% 至 90% 的 5 v) 和 安排时间 从 一个 电压 水平的 的 1.6 v.
2
上升 和 下降 时间 应当 是 非 变长 比 50 ns.
规格 主题 至 改变 没有 注意.
t
1
t
2
t
5
t
6
t
3
t
4
t
7
t
8
t
9
t
10
LDAC
CLR
WR
CS
a0, a1, a2
数据
V
输出
V
输出
t
11
图示 1. 定时 图解
(v
CC
= +5 v
5%; v
DD
= +15 v
5%; v
SS
= –15 v
5%; 地 = dutgnd = 0 v)
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