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资料编号:1056192
 
资料名称:ADS7870
 
文件大小: 269064K
   
说明
 
介绍:
12-Bit, ADC, MUX, PGA and Internal Reference Data Acquisition System
 
 


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®
ADS7870
管脚 # 名字 i/o 描述
1 ln 0 相似物 输入 mux 输入 线条 0
2 ln 1 相似物 输入 mux 输入 线条 1
3 ln 2 相似物 输入 mux 输入 线条 2
4 ln 3 相似物 输入 mux 输入 线条 3
5 ln 4 相似物 输入 mux 输入 线条 4
6 ln 5 相似物 输入 mux 输入 线条 5
7 ln 6 相似物 输入 mux 输入 线条 6
8 ln 7 相似物 输入 mux 输入 线条 7
9 重置 数字的 输入 主控 重置 零’s 所有 寄存器.
10 上升/下降 数字的 输入
sets 这 起作用的 边缘 为 sclk. “0” sets sclk 起作用的 在 下落 边缘. “1” sets sclk 起作用的 在 rising 边缘.
11 i/o 0 数字的 输入/输出 数字的 输入 或者 输出 信号
12 i/o 1 数字的 输入/输出 数字的 输入 或者 输出 信号
13 i/o 2 数字的 输入/输出 数字的 输入 或者 输出 信号
14 i/o 3 数字的 输入/输出 数字的 输入 或者 输出 信号
15 NC 非 连接 做 不 连接 至 这个 管脚.
16 转变 数字的 输入 “0” 至 “1” 转变 开始 一个 转换 循环.
17 BUSY 数字的 输出 “1” indicates 转换器 是 busy
18 osc 使能 数字的 输入 “0” sets cclk 作 输入, “1” sets cclk 作 输出 和 转变 振荡器 在.
19 CCLK 数字的 输入/输出 如果 osc 使能 = “1” 然后 内部的 振荡器 是 输出 至 这个 管脚. 如果 osc 使能 = “0” 然后 这个 是
这 输入 管脚 为 一个 外部 转换 时钟.
20 SCLK 数字的 输入 串行 数据 输入/输出 转移 时钟. 起作用的 边缘 设置 用 这 上升/下降 管脚. 如果 rise/fall 是 low,
sclk 是 起作用的 在 这 下落 边缘.
21 DIN 数字的 输入 串行 数据 输入. 在 这 3-线 模式, 这个 管脚 是 使用 为 串行 数据 输入. 在 这 2-wire 模式 串行
数据, 输出 呈现 在 这个 管脚 作 好 作 这 dout 管脚.
22 DOUT 数字的 输出 串行 数据 输出. 这个 管脚 是 驱动 当 cs 是 低 和 是 高 阻抗 当 cs 是 高. 这个
管脚 behaves 这 一样 在 两个都 3-线 和 2-线 模式.
23 CS 数字的 输入 碎片 选择. 当 cs 是 低 这 串行 接口 是 使能. 当 cs 是 高 这 串行 接口 是
无能, 这 dout 管脚 是 高 阻抗, 和 这 din 管脚 是 一个 输入. 这 cs 管脚 仅有的 影响 这
运作 的 这 串行 接口. 它 做 不 直接地 使能/使不能运转 这 运作 的 这 信号
转换 处理.
24 V
DD
电源 电源 供应 电压, +2.7v 至 +5.5v.
25 电源 电源 供应 地面.
26 V
REF
相似物 输出 2.048v/2.5v 在-碎片 电压 涉及
27 BUF
相似物 输入 输入 至 涉及 缓存区 放大器
28 BUF
输出
/ref
相似物 输出/输入 输出 从 涉及 缓存区 放大器 和 涉及 输入 至 模数转换器.
管脚 assignments
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