SN74LS175
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2
连接 图解 插件
(顶 视图)
数据 输入
时钟 (起作用的 高 going 边缘) 输入
主控 重置 (起作用的 低) 输入
真实 输出
complemented 输出
D
0
– d
3
CP
MR
Q
0
– q
3
Q
0
– q
3
0.5 u.l.
0.5 u.l.
0.5 u.l.
10 u.l.
10 u.l.
0.25 u.l.
0.25 u.l.
0.25 u.l.
5 u.l.
5 u.l.
注释:
一个) 1 ttl 单位 加载 (u.l.) = 40
m
一个 高/1.6 毫安 低.
高 低
(便条 一个)
加载
管脚 names
逻辑 图解
便条:
这 flatpak 版本 有 这 一样
pinouts (连接 图解) 作
这 双 在-线条 包装.
V
CC
= 管脚 16
地 = 管脚 8
= 管脚 号码
逻辑 标识
V
CC
= 管脚 16
地 = 管脚 8
12
1
236711141510
45 13
9CP
D
0
D
1
D
2
D
3
MR
Q
0
Q
0
Q
1
Q
1
Q
2
Q
2
Q
3
Q
3
DQ
CP
C
D
Q
CP D
3
D
2
D
1
D
0
Q
3
Q
3
Q
2
Q
2
Q
1
Q
1
Q
0
Q
0
DQ
CP
C
D
Q
MR
14
1
267
3
459
11
12
10
13
15
DQ
CP
C
D
Q
DQ
CP
C
D
Q
14 13 12 11 10 9
123456
7
16 15
8
V
CC
MR
Q
3
Q
3
D
3
D
2
Q
2
Q
2
CP
Q
0
Q
0
D
0
D
1
Q
1
Q
1
地