tlc32040c, tlc32040i, tlc32041c, tlc32041i
相似物 接口 电路
slas014e – 九月 1987 – 修订 将 1995
8
邮递 办公室 盒 655303
•
达拉斯市, 德州 75265
重置
一个 重置 函数 是 提供 至 initiate 串行 communications 在 这 aic 和 dsp 和 准许 快,
费用-有效的 测试 在 制造. 这 重置 函数 initializes 所有 aic 寄存器, 包含 这 控制
寄存器. 之后 一个 负的-going 脉冲波 在 重置
, 这 aic 是 initialized. 这个 initialization 准许 正常的 串行 端口
communications activity 至 出现 在 aic 和 dsp (看 aic dx 数据 文字 format 部分).
loopback
这个 特性 准许 这 用户 至 测试 这 电路 remotely. 在 loopback, 输出+ 和 输出– 是 内部 连接
至 在+ 和 在–. 因此, 这 dac 位 (d15 至 d2), 这个 是 transmitted 至 dx, 能 是 对照的 和 这 模数转换器
位 (d15 至 d2), 这个 是 received 从 dr. 一个 完美的 comparison 将 是 那 这 位 在 dr equal 这 位
在 dx. 不管怎样, 在 实践 那里 是 一些 区别 在 这些 位 预定的 至 这 模数转换器 和 dac 输出 补偿.
在 loopback, 如果 在+ 和 n– 是 使能, 这 外部 信号 在 在+ 和 在– 是 ignored. 如果 aux 在+ 和 aux
在– 是 使能, 这 外部 信号 在 这些 terminals 是 增加 至 这 输出+ 和 输出– 信号 在 loopback
运作.
这 loopback 特性 是 执行 和 数字的 信号 处理器 控制 用 transmitting 这 适合的 串行
端口 位 至 这 控制 寄存器 (看 aic dx 数据 文字 format 部分).
explanation 的 内部的 定时 配置
所有 的 这 内部的 定时 的 这 aic 是 获得 从 这 高-频率 时钟 信号 那 驱动 这 主控 时钟
输入. 这 变换 时钟 信号, 这个 strobes 这 串行 端口 数据 在 这 aic 和 dsp, 是 获得 用 dividing
这 主控 时钟 输入 信号 频率 用 四.
SCF 时钟 频率
+
主控 时钟 频率
2
内容 的 计数器 一个
转换 频率
+
SCF 时钟 频率
内容 的 计数器 B
变换 时钟 频率
+
主控 时钟 频率
4
tx 计数器 一个 和 tx 计数器 b, 这个 是 驱动 用 这 主控 时钟 信号, 决定 这 d/一个 转换
定时. similarly, rx 计数器 一个 和 rx 计数器 b 决定 这 一个/d 转换 定时. 在 顺序 为 这
切换-电容 低-通过 和 带宽 通过 过滤 至 满足 它们的 转移 函数 规格, 这 频率
的 这 时钟 输入 的 这 切换-电容 过滤 必须 是 288 khz. 如果 这 发生率 的 这 时钟 输入 是
不 288 khz, 这 过滤 转移 函数 发生率 是 scaled 用 这 ratios 的 这 时钟 发生率 至 288 khz.
因此, 至 获得 这 指定 过滤 responses, 这 结合体 的 主控 时钟 频率 和 tx 计数器 一个 和
rx 计数器 一个 值 必须 yield 288-khz 切换-电容 时钟 信号. 这些 288-khz 时钟 信号 能
然后 是 分隔 用 这 tx 计数器 b 和 rx 计数器 b 至 establish 这 d/一个 和 一个/d 转换 timings.
tx 计数器 一个 和 tx 计数器 b 是 reloaded 每 d/一个 转换 时期, 当 rx 计数器 一个 和 rx 计数器
b 是 reloaded 每 一个/d 转换 时期. 这 tx 计数器 b 和 rx 计数器 b 是 承载 和 这 值
在 这 tb 和 rb 寄存器, 各自. 通过 软件 控制, 这 tx 计数器 一个 能 是 承载 和 也 这
ta 寄存器, 这 ta 寄存器 较少 这 ta’ 寄存器, 或者 这 ta 寄存器 加 这 ta’ register. 用 selecting 这 ta
寄存器 较少 这 ta’ 寄存器 选项, 这 upcoming 转换 定时 将 出现 早期 用 一个 数量 的 时间 那
相等 ta’ 时间 这 信号 时期 的 这 主控 时钟. 用 selecting 这 ta 寄存器 加 这 ta’ 寄存器 选项,
这 upcoming 转换 定时 将 出现 后来的 用 一个 数量 的 时间 那 相等 ta’ 时间 这 信号 时期 的
这 主控 时钟. 因此, 这 d/一个 转换 定时 能 是 先进的 或者 retarded. 一个 完全同样的 能力 至 改变 这
一个/d 转换 定时 是 提供. 在 这个 情况, 不管怎样, 这 rx 计数器 一个 能 是 编写程序 通过 软件
控制 和 这 ra 寄存器, 这 ra 寄存器 较少 这 ra’ 寄存器, 或者 这 ra 寄存器 加 这 ra’ register.
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