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xcr5128c: 128 macrocell cpld 和 增强 clocking
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ds042 (v1.3) october 9, 2000
1-800-255-7778
这个 产品 有 被 停止. 请 看www.xilinx.com/partinfo/notify/pdn0007.htm为 详细信息.
逻辑 块 architecture
图示 2illustrates 这 逻辑 块 architecture. 各自 逻辑
块 包含 控制 条款, 一个 pal 排列, 一个 pla 排列, 和
16 macrocells. 这 六 控制 条款 能 individually 是
配置 作 也 总 或者 产品 条款, 和 是
使用 至 控制 这 preset/重置 和 输出 使能 的 这
16 macrocells
’
flip-flops. 在 增加, 二 的 这 控制
条款 能 是 使用 作 时钟 信号 (看 macrocell archi-
tecture 部分 为 详细信息). 这 pal 排列 组成 的 一个 pro-
grammable 和 排列 和 一个 fixed 或者 排列, 当 这 pla
排列 组成 的 一个 可编程序的 和 排列 和 一个 pro-
grammable 或者 排列. 这 pal 排列 提供 一个 高 速
path 通过 这 排列, 当 这 pla 排列 提供
增加 产品 期 密度.
各自 macrocell 有 five 专心致志的 产品 条款 从 这
pal 排列. 这 管脚-至-管脚 t
PD
的 这 xcr5128c 设备
通过 这 pal 排列 是 7.5 ns. 如果 一个 macrocell needs 更多
比 five 产品 条款, 它 simply gets 这 额外的 产品
条款 从 这 pla 排列. 这 pla 排列 组成 的 32
产品 条款, 这个 是 有 为 使用 用 所有 16 macro-
cells. 这 额外的 传播 延迟 incurred 用 一个 mac-
rocell 使用 一个 或者 所有 32 pla 产品 条款 是 just 2 ns. 所以
这 总的 管脚-至-管脚 t
PD
为 这 xcr5128c 使用 六 至 37
产品 条款 是 9.5 ns (7.5 ns 为 这 pal + 2 ns 为 这
pla).
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