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资料编号:1082285
 
资料名称:MPC940L
 
文件大小: 118634K
   
说明
 
介绍:
Low Voltage 1:18 Clock Distribution Chlp
 
 


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MPC940L
定时 解决方案
dl207 — rev 0
5 MOTOROLA
直流 特性
(t
一个
= 0
°
至 70
°
c, v
CCI
= 2.5v
±
5%; v
CCO
= 2.5v
±
5%)
标识 典型的 最小值 Typ 最大值 单位 情况
V
IH
输入 高 电压 cmos_clk 2.0 V
CCI
V
V
IL
输入 低 电压 cmos_clk 0.8 V
V
PP
peak–to–peak 输入 电压 pecl_clk 500 1000 mV
V
CMR
一般 模式 范围 pecl_clk V
CC
–1.0 V
CC
–0.6 V
V
OH
输出 高 电压 1.8 V I
OH
= –12ma
V
OL
输出 低 电压 0.5 V I
OH
= 12ma
I
输入 电流
±
200
µ
一个
C
输入 电容 4.0 pF
C
pd
电源 消耗 电容 10 pF 每 输出
Z
输出
输出 阻抗 18 23 28
W
I
CC
最大 安静的 供应 电流 0.5 1.0 毫安
交流 特性
(t
一个
= 0
°
至 70
°
c, v
CCI
= 2.5v
±
5%; v
CCO
= 2.5v
±
5%)
标识 典型的 最小值 Typ 最大值 单位 情况
F
最大值
最大 输入 频率 200 MHz
t
PLH
传播 延迟 pecl_clk
150MHz
cmos_clk
150MHz
2.6
2.3
4.0
3.1
5.2
4.0
ns 便条 1.
t
PLH
传播 延迟 pecl_clk > 150mhz
cmos_clk > 150mhz
2.8
2.3
3.8
3.1
5.0
4.0
ns
t
sk(o)
output–to–output skew pecl_clk
cmos_clk
200
200
ps 便条 1.
t
sk(pp)
part–to–part skew pecl_clk < 150mhz
cmos_clk < 150mhz
2.6
1.7
ns 注释 1., 2.
t
sk(pp)
part–to–part skew pecl_clk > 150mhz
cmos_clk > 150mhz
2.2
1.7
ns 注释 1., 2.
t
sk(pp)
part–to–part skew pecl_clk
cmos_clk
1.2
1.0
ns 注释 1., 3.
直流 输出 职责 循环 f
CLK
< 134 mhz
f
CLK
250 mhz
45
40
50
50
55
60
%
%
输入 直流 = 50%
输入 直流 = 50%
t
r
, t
f
输出 上升/下降 时间 0.3 1.2 ns 0.5 – 1.8 v
1. 测试 使用 标准 输入 水平, 生产 测试 @ 150mhz.
2. 横过 温度 和 电压 范围, 包含 输出 skew.
3. 为 一个 明确的 温度 和 电压, 包含 输出 skew.
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