M25P05
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spi modES
这些 设备 能 是 驱动 用 一个 微控制器
和 它的 spi 附带的 运动 在 也 的 这 二
下列的 模式:
– cpol=0, cpha=0
– cpol=1, cpha=1
为 这些 二 模式, 输入 数据 是 latched 在 在
这 rising 边缘 的 串行 时钟 (c), 和 输出 数据
是 有 从 这 下落 边缘 的 串行 时钟
(c).
这 区别 在 这 二 模式, 作 显示
在 图示 5, 是 这 时钟 极性 当 这 总线 mas-
ter 是 在 保卫-用 模式 和 不 transferring 数据:
– c 仍然是 在 0 为 (cpol=0, cpha=0)
– c 仍然是 在 1 为 (cpol=1, cpha=1)
图示 4. 总线 主控 和 记忆 设备 在 这 spi 总线
便条: 1. 这 写 保护 (w) 和 支撑 (支撑) 信号 应当 是 驱动, 高 或者 低 作 适合的.
图示 5. spi 模式 supported
AI03746C
总线 主控
(st6, st7, st9,
st10, 其他)
spi 记忆
设备
SDO
SDI
SCK
CQD
S
spi 记忆
设备
CQD
S
spi 记忆
设备
CQD
S
CS3 CS2 CS1
spi 接口 和
(cpol, cpha) =
(0, 0) 或者 (1, 1)
W
支撑
W
支撑
W
支撑
AI01438
C
C
MSB LSB
CPHA
d 或者 q
0
1
CPOL
0
1
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