max548a/max549a/max550a
+2.5v 至 +5.5v, 低-电源, 单独的/双,
8-位 电压-输出 dacs 在 µmax 包装
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_______________详细地 描述
相似物 部分
这 max548a/max549a/max550a 是 8-位, 电压-
输出 数字的-至-相似物 转换器 (dacs). 这
max548a/max549a 是 双 dacs, 和 这 max550a
是 一个 单独的 dac. 各自 dac 组成 的 一个 r-2r ladder
网络 那 converts 8-位 数字的 输入 在 相等的
相似物 输出 电压 在 份额 至 这 应用 ref-
erence 电压 (图示 1).
这 dacs 特性 翻倍-缓冲 输入 和
unbuffered 输出. 这 max549a/max550a 需要
一个 外部 涉及. 这 max548a’s 涉及 输入
是 内部 连接 至 v
DD
. 这 电源-供应
范围 是 从 +2.5v 至 +5.5v.
涉及 输入
这 电压 应用 在 ref (v
DD
为 这 max548a) sets
这 全部-规模 输出 为 所有 这 dacs 和 将 范围
从 +2.5v 至 v
DD
. 这 ref 输入 阻抗 是 代号
依赖, 和 这 最低 值 occurring 和 代号
01010101 (55 十六进制). 至 降低 inl errors, 这 谈及-
ence 电压 源 应当 有 较少 比 3
Ω
输出
阻抗.
dac 输出
这 max548a/max549a/max550a 包含 dacs 和
unbuffered 输出; 各自 输出 connects 直接地 至 一个
r-2r ladder. 典型 输出 阻抗 是 33.3k
Ω
. 这个
配置 降低 电源 消耗量 和
减少 补偿 errors. 为 最高的 精度, 应用 高
resistive 负载 (1m
Ω
和 向上). 更小的 resistive 负载 能
是 驱动, 但是 输出 加载 增加 全部-规模 错误.
这 巨大 的 这 预期的 错误 是 这 比率 的 这
dac 输出 阻抗 至 这 直流 加载 阻抗 在 这
输出.
典型地, 一个 活力 脉冲波 是 结合 在 这 dac 输出-
放 在
CS
’s rising 边缘. 自从 各自 dac 输出 是
unbuffered, 连接 一个 小 电容 (200pf 至
1000pf) 从 这 输出 至 地面 creates 一个 lowpass
过滤 那 effectively 抑制 这 脉冲波 为 敏感的
产品 (看
典型 运行 特性
).
关闭 模式
当 这 max548a/max549a/max550a 是 在 shut-
向下 模式, 这 r-2r ladder disconnects 从 这 谈及-
ence 源. 这 max549a/max550a 供应 电流
做 不 改变, 但是 这 ref 输入 电流 减少 至
较少 比 1µa. 这个 准许 这 externally 应用 系统
涉及 至 仍然是 起作用的 和 minimal 电源
消耗量. 这 max548a 供应 电流 也
减少 至 较少 比 1µa 在 关闭 模式. 当 这
max548a/max549a/max550a exit 关闭 模式,
恢复 时间 是 相等的 至 这 dac’s 安排好 时间.
串行 接口
这 串行 接口 是 spi/qspi 和 microwire compati-
ble. 一个 起作用的-低 碎片 选择 (
CS
) 使能 这 输入
变换 寄存器 至 receive 数据 从 这 串行 输入 (din).
数据 是 clocked 在 这 变换 寄存器 在 这 rising 边缘
的 这 串行-时钟 信号 (sclk). 这 时钟 频率
能 是 作 高 作 10mhz.
transmit 数据 msb 第一 在 一个 16-位 文字 或者 二 8-位
字节. 这 写 循环 能 是 segmented 至 准许 二
8-位-宽 transfers 当
CS
仍然是 低. 之后 所有 16
位 是 clocked 在 这 输入 变换 寄存器, 一个 rising
2R
R
R
R
R
2R
2R
2R
2R 2R
REF
地
便条: 转变 positions 显示 为 dac 代号 ff 十六进制.
dac_ 寄存器
输出_
MSBLSB
地
2R
R
R
R
2R
2R
2R 2R
图示 1. dac simplified 电路 图解
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