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资料编号:1132228
 
资料名称:74LS73A
 
文件大小: 53.28K
   
说明
 
介绍:
Dual Negative-Edge-Triggered Master-Slave J-K Flip-Flops with Clear and Complementary Outputs
 
 


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DM74LS73A
电的 特性
在 推荐 运行 自由 空气 温度 范围 (除非 否则 指出)
便条 5:
所有 typicals 是 在 v
CC
=
5v, t
一个
=
25
°
c.
便条 6:
不 更多 比 一个 输出 应当 是 短接 在 一个 时间, 和 这 持续时间 应当 不 超过 一个 第二. 为 设备, 和 反馈从 这 输出,
在哪里 shorting 这 输出 至 地面 将 导致 这 输出 至 改变 逻辑 状态, 一个 相等的 测试 将 是 执行 在哪里 v
O
=
2.125v 和 这 迷你-
mum 和 最大 限制 减少 用 一个 half 从 它们的 陈述 值. 这个 是 非常 有用的 当 使用 自动 测试 设备.
便条 7:
和 所有 输出 打开, i
CC
是 量过的 和 这 q 和 q 输出 高 在 转变. 在 这 时间 的 度量, 这 时钟 是 grounded.
切换 特性
在 v
CC
=
5v 和 t
一个
=
25
°
C
标识 参数 情况 最小值
典型值
最大值 单位
(便条 5)
V
I
输入 clamp 电压 V
CC
=
最小值, i
I
=
18 毫安
1.5 V
V
OH
高 水平的 V
CC
=
最小值, i
OH
=
最大值
2.7 3.4 V
输出 电压 V
IL
=
最大值, v
IH
=
最小值
V
OL
低 水平的 v
CC
=
最小值, i
OL
=
最大值
0.35 0.5
输出 电压 V
IL
=
最大值, v
IH
=
最小值 V
I
OL
=
4 毫安, v
CC
=
最小值 0.25 0.4
I
I
输入 电流 @ 最大值 V
CC
=
最大值 j, k 0.1
输入 电压 V
I
=
7V Clear 0.3 毫安
时钟 0.4
I
IH
高 水平的 V
CC
=
最大值 j, k 20
输入 电流 V
I
=
2.7v Clear 60
µ
一个
时钟 80
I
IL
低 水平的 v
CC
=
最大值 j, k
0.4
输入 电流 V
I
=
0.4v Clear
0.8 毫安
时钟
0.8
I
OS
短的 电路 输出 电流 V
CC
=
最大值 (便条 6)
20
100 毫安
I
CC
供应 电流 V
CC
=
最大值 (便条 7) 4 6 毫安
从 (输入)
R
L
=
2 k
标识 参数
至 (Output)
C
L
=
15 pf C
L
=
50 pf 单位
最小值 最大值 最小值 最大值
f
最大值
最大 时钟 频率 30 25 MHz
t
PHL
传播 延迟 时间 Clear
20 28 ns
高-至-低 水平的 输出 至 q
t
PLH
传播 延迟 时间 Clear
20 24 ns
低-至-高 水平的 输出 至 q
t
PLH
传播 延迟 时间 时钟 至
20 24 ns
低-至-高 水平的 输出 q 或者 q
t
PHL
传播 延迟 时间 时钟 至
20 28 ns
高-至-低 水平的 输出 q 或者 q
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