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资料编号:114166
 
资料名称:A3984SLP-T
 
文件大小: 350.12K
   
说明
 
介绍:
DMOS Microstepping Driver with Translator
 
 


: 点此下载
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7
26184.30a
worcester, massachusetts 01615-0036 (508) 853-5000
115 northeast 截止, 盒 15036
www.allegromicro.com
allegro microsystems, 公司
A3984
dmos microstepping 驱动器 和 翻译
管脚 是 系 至 一个 外部 电压 > 3 v, 然后 t
defaults 至
30
μ
s. 这 rosc 管脚 能 是 safely 连接 至 这 vdd
管脚 为 这个 目的. 这 值 的 t
(
μ
s) 是 大概
t
(r
OSC
880) + 1.6
blanking.
这个 函数 blanks 这 输出 的 这 电流
sense comparators 当 这 输出 是 切换 用 这
内部的 电流 控制 电路系统. 这 比较器 输出 是
blanked 至 阻止 false overcurrent 发现 预定的 至 反转
恢复 电流 的 这 clamp 二极管, 和 切换 tran-
sients related 至 这 电容 的 这 加载. 这 blank 时间,
t
BLANK
(
μ
s), 是 大概
t
BLANK
1
μ
s
承担 打气
(cp1 和 cp2).
这 承担 打气 是
使用 至 发生 一个 门 供应 更好 比 那 的 vbb
为 驱动 这 源-一侧 dmos 门. 一个 0.1
μ
f 陶瓷的
电容, 应当 是 连接 在 cp1 和 cp2. 在
增加, 一个 0.1
μ
f 陶瓷的 电容 是 必需的 在
vcp 和 vbb, 至 act 作 一个 reservoir 为 运行 这
高-一侧 dmos 门.
VREG
(vreg)
.
这个 内部-发生 电压 是 使用
至 运作 这 下沉-一侧 dmos 输出. 这 vreg 管脚 必须
是 decoupled 和 一个 0.22
μ
f 电容 至 地面. vreg
是 内部 监控. 在 这 情况 的 一个 故障 情况, 这
dmos 输出 的 这 a3984 是 无能.
使能 输入
(使能)
.
这个 输入 转变 在 或者 止 所有 的
这 dmos 输出. 当 设置 至 一个 逻辑 高, 这 输出 是
无能. 当 设置 至 一个 逻辑 低, 这 内部的 控制 使能
这 输出 作 必需的. 这 翻译 输入 步伐, dir,
ms1, 和 ms2, 作 好 作 这 内部的 sequencing 逻辑, 所有
仍然是 起作用的, 独立 的 这 使能 输入 状态.
关闭.
在 这 事件 的 一个 故障, overtemperature
(excess t
J
) 或者 一个 欠压 (在 vcp), 这 dmos 输出-
puts 的 这 a3984 是 无能 直到 这 故障 情况 是
移除. 在 电源-在, 这 uvlo (欠压 lockout)
电路 使不能运转 这 dmos 输出 和 resets 这 翻译 至
这 home 状态.
睡眠 模式
(睡眠).
至 降低 电源 消耗量
当 这 发动机 是 不 在 使用, 这个 输入 使不能运转 更 的 这
内部的 电路系统 包含 这 输出 dmos fets, 电流
调整器, 和 承担 打气. 一个 逻辑 低 在 这 睡眠 管脚
puts 这 a3984 在 睡眠 模式. 一个 逻辑 高 准许 正常的
运作, 作 好 作 开始-向上 (在 这个 时间 这 a3984 驱动
这 发动机 至 这 home microstep 位置). 当 emerging
从 睡眠 模式, 在 顺序 至 准许 这 承担 打气 至 stabi-
lize, 提供 一个 延迟 的 1 ms 在之前 issuing 一个 步伐 command.
mixed decay 运作.
这 桥 能 运作 在
mixed decay 模式, 取决于 在 这 步伐 sequence, 作
显示 在 计算数量 3 thru 5. 作 这 trip 要点 是 reached, 这
a3984 initially 变得 在 一个 快 decay 模式 为 31.25% 的
这 止-时间. t
. 之后 那, 它 switches 至 慢 decay 模式
为 这 remainder 的 t
.
同步的 整流
.
当 一个 pwm-止 循环
是 triggered 用 一个 内部的 fixed–off-时间 循环, 加载 电流
recirculates 符合 至 这 decay 模式 选择 用 这
控制 逻辑. 这个 同步的 整流 特性 转变 在
这 适合的 fets 在 电流 decay, 和 effectively
shorts 输出 这 身体 二极管 和 这 低 dmos r
DSON
. 这个
减少 电源 消耗 significantly, 和 能 eliminate
这 需要 为 外部 肖特基 二极管 在 许多 产品.
turning 止 synchronous 整流 阻止 这 倒置 的
这 加载 电流 当 一个 零-电流 水平的 是 发现.
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