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资料编号:123489
 
资料名称:ADF4112BRU
 
文件大小: 263.71K
   
说明
 
介绍:
RF PLL Frequency Synthesizers
 
 


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rev. 0
adf4110/adf4111/adf4112/adf4113
11
可编程序的
延迟
U3
CLR2
Q2D2
U2
CLR1
Q1D1
承担
打气
向下
向上
HI
HI
U1
ABP1 ABP2
r 分隔物
n 分隔物
cp 输出
r 分隔物
n 分隔物
CP
CPGND
V
P
图示 27. pfd simpli
ed 图式 和 定时
(在 锁)
muxout 和 锁 发现
这 输出 多路调制器 在 这 adf4110 家族 准许 这
用户 至 进入 各种各样的 内部的 点 在 这 碎片. 这 状态 的
muxout 是 控制 用 m3, m2 和 m1 在 这 函数
获得. 表格 v 显示 这 全部 真实 表格. 图示 28 显示 这
muxout 部分 在 块 图解 表格.
锁 发现
muxout 能 是 编写程序 为 二 类型 的 锁 发现:
数字的 锁 发现 和 相似物 锁 发现.
数字的 锁 发现 是 起作用的 高. 当 ldp 在 这 r 计数器
获得 是设置 至 0, 数字的 锁 发现 是 设置 高当 这 阶段
错误 在 三 consecutive 阶段 探测器 循环 是 较少 比 15 ns.
和 ldp 设置 至 1, five consecutive 循环 的 较少 比 15 ns
是 必需的 至 设置 这 锁 发现. 它 将 停留 设置 高 直到 一个
阶段 错误 的 更好 比 25 ns 是发现 在 任何 subsequent
pd 循环.
这 n-频道 打开-流 相似物 锁 发现 应当 是 oper-
ated 和 一个 外部 拉-向上 电阻 的 10 k
名义上的. 当
锁 有 被 发现 这个 输出 将 是 高 和 narrow 低-
going 脉冲.
CONTROLMUX
DV
DD
MUXOUT
DGND
相似物 锁 发现
数字的 锁 发现
r 计数器 输出
n 计数器 输出
SDOUT
图示 28. muxout 电路
输入 变换 寄存器
这 adf4110 family 数字的 部分 在cludes 一个 24-位 输入 变换
寄存器, 一个 14-位 r 计数器 和 一个 19-位 n 计数器, comprising
一个 6-位 一个 计数器 和 一个 13-位 b 计数器. 数据 是 clocked 在
这 24-位 变换 寄存器 在 各自 rising 边缘 的 clk. 这 数据 是
clocked 在 msb
rst. 数据 是 transferred 从 这 变换 寄存器
至 一个 的 四 latches 在 这 rising 边缘 的 le. 这 destination
获得 是 决定 用 这 状态 的 这 二 控制 位 (c2, c1)
在 这 变换 寄存器. 这些 是 这 二 lsbs db1, db0 作
显示 在 这 定时 图解 的 图示 1. 这 真实 表格 为
这些 位 是 显示 在 表格 vi. 表格 i 显示 一个 summary 的
如何 这 latches 是 编写程序.
表格 i. c2, c1 真实 表格
控制 位
C2 C1 数据 获得
0 0 r 计数器
0 1 n 计数器 (一个 和 b)
1 0 函数 获得 (包含 预分频器)
1 1 initialization 获得
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