ADN2812
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管脚 配置 和 function 描述
04228-0-029
test1 1
vcc 2
vref 3
管脚 1
指示信号
顶 视图
(不 至 规模)
24 vcc
23 vee
22 los
21 sda
32 test2
20 sck
19 saddr5
18 vcc
17 vee
thradj 9
refclkp 10
refclkn 11
vcc 12
vee 13
cf2 14
cf1 15
lol 16
NIN 4
管脚 5
SLICEP 6
SLICEN 7
VEE 8
31 vcc
30 vee
29 dataoutp
28 dataoutn
27 squelch
26 clkoutp
25 clkoutn
ADN2812*
* 那里 是 一个 exposed 垫子 在 这 bottom 的
这 包装 那 必须 是 连接 至 地.
图示 4. 管脚 配置
表格 5. 管脚 函数 描述
管脚 非. Mnemonic 类型
1
描述
1 TEST1 连接 至 vcc.
2 VCC P 电源 为 limamp, los.
3 VREF AO 内部的vref 电压. 分离 至 地 和 一个 0.1 µf 电容.
4 NIN AI 差别的 数据 输入. cml.
5 管脚 AI 差别的 数据 输入. cml.
6 SLICEP AI 差别的 slice 水平的 调整 输入.
7 SLICEN AI 差别的 slice 水平的 调整 输入.
8 VEE P 地 为 limamp, los.
9 THRADJ AI los 门槛 设置 电阻.
10 REFCLKP DI 差别的 refclk 输入. 12.3 mhz 至 200 mhz.
11 REFCLKN DI 差别的 refclk 输入. 12.3 mhz 至 200 mhz.
12 VCC P vco 电源.
13 vee p vco 地.
14 CF2 AO 频率 循环 电容.
15 CF1 AO 频率 循环 电容.
16 LOL 做 丧失 的 锁 指示信号. lvttl 起作用的 高.
17 VEE P fll 探测器 地.
18 VCC P fll 探测器 电源.
19 SADDR5 DI 从动装置 地址 位 5.
20 sck di i
2
c 时钟 输入.
21 sda di i
2
c 数据 输入.
22 LOS 做 丧失 的 信号 发现 输出. 起作用的 高. lvttl.
23 VEE P 输出 缓存区, i
2
c 地.
24 VCC P 输出 缓存区, i
2
c 电源.
25 clkoutn 做 差别的 recovered 时钟 输出. cml.
26 CLKOUTP 做 差别的 recovered 时钟 输出. cml.
27 SQUELCH DI 使不能运转 时钟 和 数据 输出. 起作用的 高. lvtll.
28 DATAOUTN 做 差别的 recovered 数据 输出. cml.
29 DATAOUTP 做 差别的 recovered 数据 输出. cml.
30 VEE P 阶段 探测器, 阶段 shifter 地.
31 VCC P 阶段 探测器, 阶段 shifter 电源.
32 TEST2 连接 至 vcc.
exposed 垫子 垫子 P 连接 至 地
1
类型: p = 电源, ai = 相似物 输入, ao = 相似物 输出, di = 数字的 input, 做 = 数字的 output.
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