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资料编号:142673
 
资料名称:AT17C65
 
文件大小: 149.83K
   
说明
 
介绍:
FPGA Configuration E2PROM
 
 


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at17lv65/128/256/512/010/002/040
2321e–cnfg–06/03
注释: 1. 交流 测试 含铅的 = 50 pf.
2. float 延迟 是 量过的 和 5 pf 交流 负载. 转变 是 量过的 ± 200 mv 从 稳步的-状态 起作用的 水平.
注释: 1. 交流 测试 含铅的 = 50 pf.
2. float 延迟 是 量过的 和 5 pf 交流 负载. 转变 是 量过的 ± 200 mv 从 稳步的-状态 起作用的 水平.
交流 特性
V
CC
= 3.3v ± 10%
标识 描述
at17lv65/128/256 at17lv512/010/002/040
单位
商业的 工业的 商业的 工业的
MinMaxMinMaxMinMaxMinMax
T
OE
(1)
oe 至 数据 延迟 50 55 50 55 ns
T
CE
(1)
CE至 数据 延迟 60 60 55 60 ns
T
CAC
(1)
clk 至 数据 延迟 75 80 55 60 ns
T
OH
数据 支撑 从 ce, oe, 或者 clk 0000 ns
T
DF
(2)
CE或者 oe 至 数据 float 延迟 55 55 50 50 ns
T
LC
clk 低 时间 25 25 25 25 ns
T
HC
clk 高 时间 25 25 25 25 ns
T
SCE
CE建制 时间 至 clk
(至 保证 恰当的 counting)
35 60 30 35 ns
T
HCE
CE支撑 时间 从 clk
(至 保证 恰当的 counting)
0000 ns
T
HOE
oe 高 时间 (guarantees 计数器 是 重置) 25 25 25 25 ns
F
最大值
最大 时钟 频率 10 10 15 10 MHz
交流 特性 当 cascading
V
CC
= 3.3v ± 10%
标识 描述
at17lv65/128/256 at17lv512/010/002/040
单位
商业的 工业的 商业的 工业的
最小值 最大值 最小值 最大值 最小值 最大值 最小值 最大值
T
CDF
(2)
clk 至 数据 float 延迟 60 60 50 50 ns
T
OCK
(1)
clk 至 ceo 延迟 55 60 50 55 ns
T
OCE
(1)
CE至 ceo延迟 55 60 35 40 ns
T
OOE
(1)
重置/oe 至 ceo延迟 40 45 35 35 ns
F
最大值
最大 时钟 频率 8 8 12.5
10
MHz
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