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4-20
应用 电路
图示 17. 典型 ca3306 7-位 决议 配置
VSS
B6
的
V
SS
V
Z
CE2
CE1
CLK
PH
V
REF
+
B5
B4
RC
B3
B2
B1
V
DD
V
在
V
REF
-
0.1
µ
F
0.1
µ
F
0.2
µ
F10
µ
F
V+
时钟
输入
调整 pot
至
1
/
2
V
Z
V+
B6
的
V
SS
V
Z
CE2
CE1
CLK
PH
V
REF
+
B5
B4
RC
B3
B2
B1
V
DD
V
在
V
REF
-
V+
0.2
µ
F
信号
输入
10
µ
F
0.1
µ
F
便条:
V
DD
必须 是
≥
V
Z
为 电路 至 工作
和 v
Z
连接 至 v
REF
+
0.1
µ
F
1K
的
B7
B6
B5
B4
B3
B2
B1
(lsb)
(msb)
数据
输出
CA3306
CA3306
ca3306, ca3306a, ca3306c

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4-20 应用电路图示 17. 典型 ca3306 7-位决议配置 VSS B6 的 V SS V Z CE2 CE1 CLK PH V REF + B5 B4 RC B3 B2 B1 V DD V 在 V REF - 0.1 µ F 0.1 µ F 0.2 µ F10 µ F V+ 时钟输入调整 pot 至 1 / 2 V Z V+ B6 的 V SS V Z CE2 CE1 CLK PH V REF + B5 B4 RC B3 B2 B1 V DD V 在 V REF - V+ 0.2 µ F 信号输入 10 µ F 0.1 µ F 便条: V DD 必须是 ≥ V Z 为电路至工作和 v Z 连接至 v REF + 0.1 µ F 1K 的 B7 B6 B5 B4 B3 B2 B1 (lsb) (msb) 数据输出 CA3306 CA3306 ca3306, ca3306a, ca3306c

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