CXD1803AQ_集成电路资料查询网

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cxd1803aq/ar
管脚 非.
标识 i/o 描述
QR
35 33 地 — 地面
36 34 SD7 i/o scsi 控制 数据 总线
37 35 SDRQ I scsi 数据 要求 积极的 逻辑 信号
38 36 XSAC O scsi acknowledge 负的 逻辑 信号
39 37 MA0 O 缓存区 记忆 地址 (lsb)
40 38 地 — 地面
41 39 MA1 O 缓存区 记忆 地址
42 40 MA2 O 缓存区 记忆 地址
43 41 MA3 O 缓存区 记忆 地址
44 42 MA4 O 缓存区 记忆 地址
45 43 MA5 O 缓存区 记忆 地址
46 44 MA6 O 缓存区 记忆 地址
47 45 地 — 地面
48 46 MA7 O 缓存区 记忆 地址
49 47 MA8 O 缓存区 记忆 地址
50 48 MA9 O 缓存区 记忆 地址
51 49 MA10 O 缓存区 记忆 地址
52 50 MA11 O 缓存区 记忆 地址
53 51 V
DD
— 电源 供应 (+5 v)
54 52 地 — 地面
55 53 MA12 O 缓存区 记忆 地址
56 54 MA13 O 缓存区 记忆 地址
57 55 XME0 O 记忆 碎片 使能 负的 逻辑 信号
58 56 MA14 O 缓存区 记忆 地址
59 57 MA15 O 缓存区 记忆 地址
60 58 地 — 地面
61 59
MA16
O
缓存区 记忆 地址
XRAS dram ras 信号
62 60 XME1 O 记忆 碎片 使能 负的 逻辑 信号
63 61
XMOE
O
缓存区 记忆 输出 使能 负的 逻辑 信号
XCAS dram cas 信号
64 62 XMWR O 缓存区 记忆 写 使能 负的 逻辑 信号
65 63 地 — 地面
66 64 MDB0 i/o 缓存区 记忆 数据 总线
67 65 MDB1 i/o 缓存区 记忆 数据 总线

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—4— cxd1803aq/ar 管脚非. 标识 i/o 描述 QR 35 33 地 — 地面 36 34 SD7 i/o scsi 控制数据总线 37 35 SDRQ I scsi 数据要求积极的逻辑信号 38 36 XSAC O scsi acknowledge 负的逻辑信号 39 37 MA0 O 缓存区记忆地址 (lsb) 40 38 地 — 地面 41 39 MA1 O 缓存区记忆地址 42 40 MA2 O 缓存区记忆地址 43 41 MA3 O 缓存区记忆地址 44 42 MA4 O 缓存区记忆地址 45 43 MA5 O 缓存区记忆地址 46 44 MA6 O 缓存区记忆地址 47 45 地 — 地面 48 46 MA7 O 缓存区记忆地址 49 47 MA8 O 缓存区记忆地址 50 48 MA9 O 缓存区记忆地址 51 49 MA10 O 缓存区记忆地址 52 50 MA11 O 缓存区记忆地址 53 51 V DD — 电源供应 (+5 v) 54 52 地 — 地面 55 53 MA12 O 缓存区记忆地址 56 54 MA13 O 缓存区记忆地址 57 55 XME0 O 记忆碎片使能负的逻辑信号 58 56 MA14 O 缓存区记忆地址 59 57 MA15 O 缓存区记忆地址 60 58 地 — 地面 61 59 MA16 O 缓存区记忆地址 XRAS dram ras 信号 62 60 XME1 O 记忆碎片使能负的逻辑信号 63 61 XMOE O 缓存区记忆输出使能负的逻辑信号 XCAS dram cas 信号 64 62 XMWR O 缓存区记忆写使能负的逻辑信号 65 63 地 — 地面 66 64 MDB0 i/o 缓存区记忆数据总线 67 65 MDB1 i/o 缓存区记忆数据总线

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