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资料编号:250050
 
资料名称:AD7943BR
 
文件大小: 329.86K
   
说明
 
介绍:
+3.3 V/+5 V Multiplying 12-Bit DACs
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
ad7943/ad7945/ad7948
rev. b–6–
ad7945 定时 规格
1
(t
一个
= t
最小值
至 t
最大值
, 除非 否则 指出)
限制 @ 限制 @
参数 V
DD
= +3 v 至 +3.6 v V
DD
= +4.5 v 至 +5.5 v 单位 描述
t
DS
35 20 ns 最小值 数据 建制 时间
t
DH
10 10 ns 最小值 数据 支撑 时间
t
CS
60 40 ns 最小值 碎片 选择 建制 时间
t
CH
0 0 ns 最小值 碎片 选择 支撑 时间
t
WR
60 40 ns 最小值 写 pulsewidth
注释
1
所有 输入 信号 是 指定 和 tr = tf = 5 ns (10% 至 90% 的 5 v) 和 安排时间 从 一个 电压 水平的 的 1.6 v.
规格 主题 至 改变 没有 注意.
数据 有效的
CS
t
CH
t
DS
t
DH
WR
DB11–DB0
t
CS
t
WR
图示 3. ad7945 定时 图解
ad7948 定时 规格
1
(t
一个
= t
最小值
至 t
最大值
, 除非 否则 指出)
限制 @ 限制 @
参数 V
DD
= +3 v 至 +3.6 v V
DD
= +4.5 v 至 +5.5 v 单位 描述
t
DS
45 30 ns 最小值 数据 建制 时间
t
DH
10 10 ns 最小值 数据 支撑 时间
t
CWS
0 0 ns 最小值
CSMSB
或者
CSLSB
至 wr 建制 时间
t
CWH
0 0 ns 最小值
CSMSB
或者
CSLSB
WR
支撑 时间
t
LWS
0 0 ns 最小值
LDAC
WR
建制 时间
t
LWH
0 0 ns 最小值
LDAC
至 wr 支撑 时间
t
WR
60 40 ns 最小值 写 pulsewidth
注释
1
所有 输入 信号 是 指定 和 tr = tf = 5 ns (10% 至 90% 的 5 v) 和 安排时间 从 一个 电压 水平的 的 1.6 v.
规格 主题 至 改变 没有 注意.
数据
有效的
数据
有效的
WR
t
CWS
t
CWH
t
CWS
t
CWH
t
LWH
t
LWS
t
DH
t
DS
t
WR
t
WR
t
DH
t
DS
CSMSB
CSLSB
LDAC
DB7–DB0
图示 4. ad7948 定时 图解
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