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资料编号:251717
 
资料名称:AD9751AST
 
文件大小: 714K
   
说明
 
介绍:
10-Bit, 300 MSPS High-Speed TxDAC+ D/A Converter
 
 


: 点此下载
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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
rev. 0
–4–
AD9751–SPECIFICATIONS
提醒
静电释放 (静电的 释放) 敏感的 设备. 静电的 charges 作 高 作 4000 v readily
accumulate 在 这 人 身体 和 测试 设备 和 能 释放 没有 发现. 虽然
这 ad9751 特性 专卖的 静电释放 保护 电路系统, 永久的 损坏 将 出现 在
设备 subjected 至 高-活力 静电的 discharges. 因此, 恰当的 静电释放 预防措施 是
推荐 至 避免 效能 降级 或者 丧失 的 符合实际.
WARNING!
静电释放 敏感的 设备
(t
最小值
至 t
最大值
, avdd = 3.3 v, dvdd = 3.3 v, pllvdd = 3.3 v, clkvdd = 3.3 v, i
OUTFS
= 20 毫安, 除非
否则 指出.)
数字的 规格
参数 最小值 典型值 最大值 单位
数字的 输入
逻辑 “1” 2.1 3 V
逻辑 “0” 0 0.9 V
逻辑 “1” 电流 –10 +10
µ
一个
逻辑 “0” 电流 –10 +10
µ
一个
输入 电容 5 pF
输入 建制 时间 (t
S
) 0.5 1.0 ns
输入 支撑 时间 (t
H
) 0.5 1.0 ns
输入 建制 时间 (t
s,
pllvdd = 0 v) –1.5 –1.0 ns
输入 支撑 时间 (t
h,
pllvdd = 0 v)) 1.7 2.5 ns
最小值 clk freq
1
6.25 MHz
绝对 最大 比率
*
参数 和 遵守 至 最小值 最大值 单位
avdd, dvdd, clkvdd, pllvdd acom, dcom, clkcom, pllcom –0.3 +3.9 V
avdd, dvdd, clkvdd, pllvdd acom, dcom, clkcom, pllcom –3.9 +3.9 V
acom, dcom, clkcom, pllcom acom, dcom, clkcom, pllcom –0.3 +3.9 V
refio, reflo, fsadj ACOM –0.3 avdd + 0.3 V
I
OUTA
, i
OUTB
ACOM –1.0 avdd + 0.3 V
数字的 数据 输入 (db9 至 db0) DCOM –0.3 dvdd + 0.3 V
clk+/clk–, plllock CLKCOM –0.3 clkvdd + 0.3 V
div0, div1, 重置 CLKCOM –0.3 clkvdd + 0.3 V
LPF PLLCOM –0.3 pllvdd + 0.3 V
接合面 温度 150
°
C
存储 温度 –65 +150
°
C
含铅的 温度 (10 秒) 300
°
C
*
压力 在之上 那些 列表 下面 绝对 最大 比率 将 导致 永久的 损坏 至 这 设备. 这个 是 一个 压力 比率 仅有的; 函数的 运作 的 这
设备 在 这些 或者 任何 其它 情况 在之上 那些 表明 在 这 运算的 sections 的 这个 规格 是 不 暗指. 暴露 至 绝对 最大 比率 为
扩展 时期 将 影响 设备 可靠性.
订货 手册
温度 包装 包装
模型 范围 描述 选项
AD9751AST –40
°
c 至 +85
°
C 48-含铅的 lqfp st-48
ad9751-eb evaluation 板
便条
最小值 clk freq 仅有的 应用 当 使用 内部的 pll. 当 pll 是 无能, 那里
是 非 最小 clk 频率.
热的 典型的
热的 阻抗
48-含铅的 lqfp
θ
JA
= 91
°
c/w
端口 1
数据 x
数据 y
t
H
t
S
t
LPW
t
PD
数据 x
数据 y
t
PD
端口 2
I
OUTA
或者 i
OUTB
输入 clk
(pll 使能)
1
时钟 @PLLLOCK
(pll 无能)
数据 在
图示 1. i/o 定时
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