AD9826KRS_集成电路资料查询网

AD9826
–9–
rev. 一个
t
AD
t
AD
t
C2ADR
相似物
输入
CDSCLK1
CDSCLK2
ADCCLK
输出
数据
d<7:0>
pixel n
pixel (n+1)
pixel (n+2)
t
C1
t
C2C1
t
C2
t
C2ADF
t
ADC2
t
ADCLK
t
ADCLK
高
字节
低
字节
ch1(n
–
2)
t
C1C2
ch2(n
–
2) ch1(n
–
1) ch2(n
–
1)
低
字节
低
字节
低
字节
低
字节
高
字节
高
字节
高
字节
高
字节
t
PRA
ch1(n)
图示 3. 2-频道 cds 模式 定时
t
AD
t
ADCLK
t
ADCLK
t
C2ADR
相似物
输入
CDSCLK2
ADCCLK
输出
数据
d<7:0>
pixel n
PIXEL
(n+1)
t
C2
t
C2ADF
t
ADC2
高
字节
低
字节
低
字节
低
字节
低
字节
低
字节
高
字节
高
字节
高
字节
高
字节
ch1(n
–
2)
ch2(n
–
2)
ch1(n
–
1) ch2(n
–
1)
ch1(n)
图示 4. 2-频道 sha 模式 定时

标　题:
内　容:
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AD9826 –9– rev. 一个 t AD t AD t C2ADR 相似物输入 CDSCLK1 CDSCLK2 ADCCLK 输出数据 d<7:0> pixel n pixel (n+1) pixel (n+2) t C1 t C2C1 t C2 t C2ADF t ADC2 t ADCLK t ADCLK 高字节低字节 ch1(n – 2) t C1C2 ch2(n – 2) ch1(n – 1) ch2(n – 1) 低字节低字节低字节低字节高字节高字节高字节高字节 t PRA ch1(n) 图示 3. 2-频道 cds 模式定时 t AD t ADCLK t ADCLK t C2ADR 相似物输入 CDSCLK2 ADCCLK 输出数据 d<7:0> pixel n PIXEL (n+1) t C2 t C2ADF t ADC2 高字节低字节低字节低字节低字节低字节高字节高字节高字节高字节 ch1(n – 2) ch2(n – 2) ch1(n – 1) ch2(n – 1) ch1(n) 图示 4. 2-频道 sha 模式定时

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