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资料编号:253551
 
资料名称:DAC121S101CIMM
 
文件大小: 907.41K
   
说明
 
介绍:
12-Bit Micro Power Digital-to-Analog Converter with Rail-to-Rail Output
 
 


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电的 特性
(持续)
显示 这个 表格 设计 targets 主题 改变 在之前 产品 释放.
下列的 specifica-
tions 应用 V
一个
= +2.7v +5.5v, R
L
=2k
地, C
L
= 200 pF 地, f
SCLK
= 30 mhz, 输入 代号 范围 48 4047.
黑体字 限制 应用 T
最小值
T
一个
T
最大值
: 所有 其它 限制 T
一个
= 25˚c, 除非 否则 指定.
标识 参数 情况
典型
(便条 9)
限制
(便条 9)
单位
(限制)
I
OS
输出 短的 电路 电流
V
一个
= 5v, V
输出
= 0v,
输入 代号 = FFFh
−63 毫安
V
一个
= 3v, V
输出
= 0v,
输入 代号 = FFFh
−50 毫安
V
一个
= 5v, V
输出
= 5v,
输入 代号 = 000h
74 毫安
V
一个
= 3v, V
输出
= 3v,
输入 代号 = 000h
53 毫安
逻辑 输入
I
输入 电流 (便条 10)
±
1
µA (最大值)
V
IL
输入 电压 (便条 10)
V
一个
=5V
0.8
V (最大值)
V
一个
=3V
0.5
V (最大值)
V
IH
输入 电压 (便条 10)
V
一个
=5V
2.4
V (最小值)
V
一个
=3V
2.1
V (最小值)
C
输入 电容 (便条 10)
3
pF (最大值)
电源 (所需的)东西
I
一个
供应 电流 (输出
unloaded)
正常的 模式
f
SCLK
=30MHz
V
一个
= 5.5v 260
312
µA (最大值)
V
一个
= 3.6v 177
217
µA (最大值)
正常的 模式
f
SCLK
=20MHz
V
一个
= 5.5v 224
279
µA (最大值)
V
一个
= 3.6v 158
197
µA (最大值)
正常的 模式
f
SCLK
=0
V
一个
= 5.5v 153 µA (最大值)
V
一个
= 3.6v 118 µA (最大值)
所有 PD 模式,
f
SCLK
=30MHz
V
一个
= 5.0v 84 µA (最大值)
V
一个
= 3.0v 42 µA (最大值)
所有 PD 模式,
f
SCLK
=20MHz
V
一个
= 5.0v 56 µA (最大值)
V
一个
= 3.0v 28 µA (最大值)
所有 PD 模式,
f
SCLK
= 0 (便条 10)
V
一个
= 5.5v 0.07
1.0
µA (最大值)
V
一个
= 3.6v 0.04
1.0
µA (最大值)
P
C
电源 消耗量 (输出
unloaded)
正常的 模式
f
SCLK
=30MHz
V
一个
= 5.5v 1.43
1.72
mW (最大值)
V
一个
= 3.6v 0.64
0.78
mW (最大值)
正常的 模式
f
SCLK
=20MHz
V
一个
= 5.5v 1.23
1.53
mW (最大值)
V
一个
= 3.6v 0.57
0.71
mW (最大值)
正常的 模式
f
SCLK
=0
V
一个
= 5.5v 0.84 µW (最大值)
V
一个
= 3.6v 0.42 µW (最大值)
所有 PD 模式,
f
SCLK
=30MHz
V
一个
= 5.0v 0.42 µW (最大值)
V
一个
= 3.0v 0.13 µW (最大值)
所有 PD 模式,
f
SCLK
=20MHz
V
一个
= 5.0v 0.28 µW (最大值)
V
一个
= 3.0v 0.08 µW (最大值)
所有 PD 模式,
f
SCLK
= 0 (便条 10)
V
一个
= 5.5v 0.39
5.5
µW (最大值)
V
一个
= 3.6v 0.14
3.6
µW (最大值)
I
输出
/i
一个
电源 效率 I
加载
= 2mA
V
一个
=5V 91 %
V
一个
=3V 94 %
DAC121S101
www.国家的.com 4
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