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资料编号:253630
 
资料名称:DAC08CQ
 
文件大小: 218.63K
   
说明
 
介绍:
8-Bit, High-Speed, Multiplying D/A Converter (Universal Digital Logic Interface)
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
rev. b
DAC08
–11–
范围, 负的 逻辑 输入 范围 和 负的 逻辑 门槛
范围; 咨询 这 各种各样的 计算数量 为 guidance. 为 例子,
运作 在
4.5 v 和 i
REF
= 2 毫安 是 不 推荐
因为 负的 输出 遵从 将 是 减少 至 near
零. 运作 从 更小的 供应 是 可能; 不管怎样, 在
least 8 v总的 必须 是 应用 至 确保 转变-在 的 这 内部的
偏差 网络.
对称的 供应 是 不 必需的, 作 这 dac08 是 quite
insensitive 至 变化 在 供应 电压. 电池 运作 是
feasible 作 非 地面 连接 是 必需的: 不管怎样, 一个 artificial
地面 将 是 使用 至 确保 逻辑 swings, 等., 仍然是
在 可接受的 限制.
电源 消耗量 将 是 计算 作 跟随:
P
D
=
(i+) (v+) + (i–) (v–)
一个 有用的 特性 的 这 dac08 设计 是 那 供应 电流 是
常量 和 独立 的 输入 逻辑 states; 这个 是 有用的 在
cryptographic 产品 和 更远 serves 至 减少 这 大小
的 这 电源 供应 绕过 电容.
温度 效能
这 非线性 和 monotonicity 规格 的 这DAC08
是 有保证的 至 应用 在 这 全部 评估 运行 温度
范围. 全部-规模 输出 电流 逐渐变化 是 低, 典型地
±
10 ppm/
°
c,
和 零-规模 输出 电流 和 逐渐变化 essentially negligible
对照的 至1/2 lsb.
这 温度 系数 的 这 涉及 电阻 r14 应当
相一致 和 追踪 那 的 这 输出 电阻 为 最小 整体的
全部-规模 逐渐变化. 安排好 时间 的 这 dac08 decrease approxi-
mately 10% 在
55
°
c; 在 +125
°
c 一个 增加 的 关于 15%
是 典型.
从 管脚 16 至 v
. 为 fixed 涉及 运作, 一个 0.01
µ
F
电容 是 推荐. 为 能变的 涉及 产品,
涉及 放大器 补偿为 乘以 applica-
tions
部分.
乘以 运作
这 dac08 提供 极好的 乘以 效能 和 一个
极其 直线的 relationship 在 i
FS
和 i
REF
在 一个 范围
的 4
µ
一个 至 4 毫安. monotonic 运作 是 maintained 在 一个
典型 范围 的 i
REF
从 100
µ
一个 至 4.0 毫安.
安排好 时间
这 dac08 是 有能力 的 极其 快 安排好 时间, 典型地
85 ns 在 i
REF
= 2.0 毫安. judicious 电路 设计 和 细致的
板 布局 必须 是 运用 至 获得 全部 效能
潜在的 在 测试 和 应用. 这 逻辑 转变 设计
使能 传播 延迟 的 仅有的 35 ns 为 各自 的 这 8 位.
安排好 时间 至 在里面 1/2 lsb 的 这 lsb 是 因此 35 ns,
和 各自 progressively 大 位 带去 successively 变长. 这
msb settles 在 85 ns, 因此 determining 这 整体的 安排好 时间
的 85 ns. 安排好 至6-位 精度 需要 关于 65 ns 至 70 ns.
这 输出 电容 的这 dac08 包含 这 包装 是
大概 15 pf, 因此 这 输出 rc 时间 常量
支配 安排好 时间 如果 r
L
> 500
.
安排好 时间 和 传播 延迟 是 相当地 insensitive 至
逻辑 输入 振幅 和 上升 和 下降 时间, 预定的 至 这 高
增益 的 这 逻辑 switches. 安排好 时间 也 仍然是 essentially
常量 为 i
REF
值. 这 principal 有利因素 的 高等级的 i
REF
值 lies 在 这 能力 至 attain 一个 给 输出 水平的 和 更小的
加载 电阻器, 因此 减少 这 输出 rc 时间 常量.
度量 的 安排好 时间 需要 这 能力 至 准确地
resolve
±
4
µ
一个, 因此 一个 1 k
加载 是 需要 至 提供
足够的 驱动 为 大多数 oscilloscopes. 这 安排好 时间 fix-
ture显示 在 图式 labelled
安排好 时间 度量
使用 一个 cascade 设计 至 准许 驱动 一个 1 k
加载 和 较少
比 5 pf 的 parasitic 电容 在 这 度量 node. 在
I
REF
值 的 较少 比 1.0 毫安, 过度的 rc damping 的 这
输出 是 difficult 至 阻止 当 维持 足够的 sensi-
tivity. 不管怎样, 这 主要的 carry 从 01111111 至 10000000
提供 一个 精确 指示信号 的 安排好 时间. 这个 代号 改变
做 不 需要 这 正常的 6.2 时间 constants 至 settle 至
在里面
±
0.2% 的 这 最终 值, 和 因此 安排好 时间 将 是
observed 在 更小的 值 的 i
REF
.
dac08 切换 过往旅客 或者
glitches
是 非常 低 和 将
是 更远 减少 用 小 电容的 负载 在 这 输出 在 一个
minor sacrifice 在 安排好 时间.
fastest 运作 能 是 得到 用 使用 短的 leads, 降低
输出 电容 和 加载 电阻 值, 和 用 足够的
bypassing 在 这 供应, 涉及, 和 v
LC
terminals. 供应
做 不 需要 大 electrolytic 绕过 电容 作 这 供应
电流 流 是 独立 的 输入 逻辑 states; 0.1
µ
f 电容
在 这 供应 管脚 提供 全部 瞬时 保护.
14
15
6789101112
4
2
5
R
REF
13
0.1
F
+15V
316
I
输出
V
R15
+V
REF
0.01
F
15V
0.1
F
DAC08
100k
2k
1k
1
F
15k
15V
V
输出
1X
探查
1k
1
F50
F
V
L
最小
电容
+5V
0.1
F
0V
0V
+0.4v
0.4v
Q2
为 转变-在, v
L
= 2.7v
为 转变-止, v
L
= 0.7v
0.1
F
V
CL
0.7v
Q1
图示 17. 安排好 时间 度量
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