DP8473V_集成电路资料查询网

函数的 描述
(持续)
这 IBM 标准 MFM 数据 rates 至 提供 两个都 FM 和
MFM 过滤 外部 逻辑 将 是 necessary
这 控制 takes 最好的 有利因素 的 这 内部的 数据
separator 用 implementing 一个 sophisticated ID 搜索 algo-
rithm 这个 algorithm 显示 在
图示 5
enhances 这
PLL’s 锁 特性 用 forcing 这 PLL 至 relock 至 这
结晶 任何 时间 这 数据 separator attempts 至 锁 至 一个
非-preamble pattern 这个 algorithm 确保 那 这 PLL
是 不 thrown 方法 输出 的 锁 用 写 splices 或者 bad 数据
fields
表格 II 典型 过滤 值 为 这 各种各样的 数据
比率 (假设
g
6% 俘获 范围)
数据 比率
C
2
R
2
C
1
R
1
(mfm bs)
过滤 值 当 使用 所有 3 数据 比率
10M C
2C
e
0012
m
F 560
X
510 pF 56 k
X
500k C
2B
e
0015
m
F
250300k C
2A
e
0033
m
F
过滤 值 当 使用 250300 和 500 kbs
500k C
2B
e
0027
m
F 560
X
1000 pF 56 k
X
250300k C
2A
e
0047
m
F 560
X
过滤 使用 仅有的 一个 数据 比率
10M C
2
e
0012
m
F 560
X
510 pF 56 k
X
500k C
2
e
0027
m
F 560
X
1000 pF 56 k
X
300250k C
2
e
0047
m
F 560
X
2000 pF 56 k
X
(这些 值 是 初步的 和 因此 是 主题 至 change)
表格 III 数据 比率 (mfm) 相比
VCO 分隔-用 因素
数据 比率 N
1 Mbs 4
500 kbs 8
300 kbs 16
250 kbs 16
PLL DIAGNOSTIC 模式
在 addition 这 DP8473 有 二 diagnostic 模式 至 使能
过滤 optimization 1) enabling 这 承担 打气 输出 sig-
nal 面向 这 PUMPPREN pin 和 2) 供应 外部
控制 的 这 读 门 信号 至 这 数据 separator 两个都
模式 是 使能 在 这 last 字节 的 这 模式 Command
这 打气 输出 信号 indicates 当 这 承担 打气 是
制造 一个 阶段 correction 和 hence whether 这 循环 是
锁 或者 not
这 读 门 function 当 enabled 准许 这 设计者
至 manually 强迫 这 数据 separator 至 锁 至 这 新当选的
数据 或者 后面的 至 这 涉及 clock 这个 使能 容易 veri-
fication 的 这 锁 特性 的 这 PLL 用 monitoring
这 过滤 pin 和 这 打气 signal
PLL 过滤 设计
这个 部分 提供 信息 至 使能 设计 的 这
数据 separator’s 外部 过滤 和 承担 打气 设置 resis-
tor 这个 discussion 是 为 一个 单独的 数据 比率 filter 和 能 是
容易地 extrapolated 至 这 其它 过滤 的
图示 4
表格 II
显示 一些 典型 过滤 组件 values 但是 如果 一个 custom
过滤 是 desired 这 下列的 参数 必须 是 consid-
ered
R
1
 承担 打气 电流 设置 resistor 这 电流
设置 用 这个 电阻 是 multiplied 用 这 承担 打气
gain K
P
这个 是
E
25 因此 这 承担 打气 cur-
rent is
I
打气
e
(25) 12VR
1
R
1
应当 是 设置 至 在
3–12 k
X
 这个 电阻 确定 这 增益 的 这 阶段
detector 这个 是 K
D
e
I
打气
2
q

TLF9384–9
图示 5 读 algorithm-状态 图解 为 数据
7

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函数的描述 (持续) 这 IBM 标准 MFM 数据 rates 至提供两个都 FM 和 MFM 过滤外部逻辑将是 necessary 这控制 takes 最好的有利因素的这内部的数据 separator 用 implementing 一个 sophisticated ID 搜索 algo- rithm 这个 algorithm 显示在图示 5 enhances 这 PLL’s 锁特性用 forcing 这 PLL 至 relock 至这结晶任何时间这数据 separator attempts 至锁至一个非-preamble pattern 这个 algorithm 确保那这 PLL 是不 thrown 方法输出的锁用写 splices 或者 bad 数据 fields 表格 II 典型过滤值为这各种各样的数据比率 (假设 g 6% 俘获范围) 数据比率 C 2 R 2 C 1 R 1 (mfm bs) 过滤值当使用所有 3 数据比率 10M C 2C e 0012 m F 560 X 510 pF 56 k X 500k C 2B e 0015 m F 250300k C 2A e 0033 m F 过滤值当使用 250300 和 500 kbs 500k C 2B e 0027 m F 560 X 1000 pF 56 k X 250300k C 2A e 0047 m F 560 X 过滤使用仅有的一个数据比率 10M C 2 e 0012 m F 560 X 510 pF 56 k X 500k C 2 e 0027 m F 560 X 1000 pF 56 k X 300250k C 2 e 0047 m F 560 X 2000 pF 56 k X (这些值是初步的和因此是主题至 change) 表格 III 数据比率 (mfm) 相比 VCO 分隔-用因素数据比率 N 1 Mbs 4 500 kbs 8 300 kbs 16 250 kbs 16 PLL DIAGNOSTIC 模式在 addition 这 DP8473 有二 diagnostic 模式至使能过滤 optimization 1) enabling 这承担打气输出 sig- nal 面向这 PUMPPREN pin 和 2) 供应外部控制的这读门信号至这数据 separator 两个都模式是使能在这 last 字节的这模式 Command 这打气输出信号 indicates 当这承担打气是制造一个阶段 correction 和 hence whether 这循环是锁或者 not 这读门 function 当 enabled 准许这设计者至 manually 强迫这数据 separator 至锁至这新当选的数据或者后面的至这涉及 clock 这个使能容易 veri- fication 的这锁特性的这 PLL 用 monitoring 这过滤 pin 和这打气 signal PLL 过滤设计这个部分提供信息至使能设计的这数据 separator’s 外部过滤和承担打气设置 resis- tor 这个 discussion 是为一个单独的数据比率 filter 和能是容易地 extrapolated 至这其它过滤的图示 4 表格 II 显示一些典型过滤组件 values 但是如果一个 custom 过滤是 desired 这下列的参数必须是 consid- ered R 1  承担打气电流设置 resistor 这电流设置用这个电阻是 multiplied 用这承担打气 gain K P 这个是 E 25 因此这承担打气 cur- rent is I 打气 e (25) 12VR 1 R 1 应当是设置至在 3–12 k X  这个电阻确定这增益的这阶段 detector 这个是 K D e I 打气 2 q  TLF9384–9 图示 5 读 algorithm-状态图解为数据 7

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