ds87c520/ds83c520 非易失存储器/只读存储器 高-速 微控制器
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兼容性
这 ds87c520/ds83c520 是 全部地 静态的 cmos 8051-竞赛atible 微控制器 设计 为 高
效能. 在 大多数 具体情况, the ds87c520/ds83c520 能 漏出 在 一个存在 插座 为 这 8xc51
家族 至 改进 这 运作 significantly. 当remaining familiar 至 8051 家族 用户, 这 设备
有 许多 新 特性. 在 一般, 软件写 为 存在 8051-为基础 系统 工作 没有
修改 在 这 ds87c520/ds83c520. 这 例外 是 critical 定时 自从 这 高-速
微控制器 执行 说明更 faster 比 这 原来的 为 任何 给 结晶 选择. 这
ds87c520/ds83c520 run 这 标准8051 家族 操作指南 设置 和 是 管脚 兼容 和 插件,
plcc, 或者 tqfp 包装.
这 ds87c520/ds83c520 提供三 16-位 计时器/counters, 全部-duplex 串行 端口 (2), 256 字节 的
直接 内存 加 1kb 的 extra movx 内存. i/o ports 有 这 一样 operation 作 一个 标准 8051
产品. 计时器 将 default 至 一个12-时钟 每 循环 运作 至 保持 它们的 定时 兼容 和
原来的 8051 家族 系统. 不管怎样, 计时器 是 individually 可编程序的 至 run 在 这 新 四
clocks 每 循环 如果 desired. 这 pca 是 不 supported.
这 ds87c520/ds83c520 提供 一些新 硬件 特性 执行 用 新 特定的 函数
寄存器. 一个 summary 的 这些 sfrs 是 提供 在下.
效能 overview
这 ds87c520/ds83c520 feature 一个 高-速 8051-兼容 核心. 高等级的 速 comes 不 just 从
增加 这 时钟 频率 但是 也从 一个 newer, 更多 效率高的 设计.
这个 updated 核心 做 不 有 这 dummy 记忆循环 那 是 呈现 在 一个 标准 8051. 一个
常规的 8051 发生 机器 循环 使用这 时钟 频率 分隔 用 12. 在 这
ds87c520/ds83c520, 这 一样 机器 cycle takes 4 clocks. 因此 这 fastest 操作指南, 1 机器
循环, executes 三 时间 faster 为 这 一样 结晶 频率. 便条 那 这些 是 完全同样的 说明.
这 majority 的 说明 在 这 ds87c520/ds83c520 将 看 这 全部 3-至-1 速 改进.
一些 说明 将 get 在 1.5 和 2.4 至 1 改进. 一个ll 说明 是 faster 比 这
原来的 8051.
这 numerical 平均 的 所有 opcodes 给 approximately 一个 2.5 至 1 速 improvement. 改进 的
单独的 programs 将 取决于 在 这 真实的 说明 使用. 速-敏感的 产品 将 制造
这 大多数 使用 的 说明 那 是 三 时间 faster. 不管怎样, 这 sheer 号码 的 3 至 1 改进
opcodes 制造 dramatic 速 improvements likely 为 任何 代号. 这些 architecture 改进
生产 一个 顶峰 操作指南 循环 在 121ns (8.25 mips). the 双 数据 pointer feature 也 准许 这 用户
至 eliminate wasted 说明 当 移动的 blocks 的 记忆.
操作指南 设置 summary
所有 说明 执行 这 一样功能 作 它们的 8051 counterparts.它们的 效应 在 位, flags, 和
其它 状态 功能 是 完全同样的. 不管怎样, 这 定时 的 各自 操作指南 是 不同的. 这个 应用 两个都
在 绝对 和 relative 号码 的 clocks.
为 绝对 定时 的 real-时间 events, 这 定时 的 所以ftware 循环 能 是 计算 使用 一个 表格 在 这
高-速 微控制器 用户’s 手册
. 不管怎样, 计数器/计时器 default 至 run 在 这 older 12 clocks
每 increment. 在 这个 方法, 计时器-为基础 events 出现 在 这 标准 间隔 和 软件 executing 在
高等级的 速. 计时器 optionally 能 run 在 4 clocks per increment 至 引领 有利因素 的 faster 处理器
运作.
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