TMS320VC33PGEA120_集成电路资料查询网

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sprs087e −二月 1999 − 修订 january 2004
5
邮递 办公室 盒 1443
•
houston, 德州 77251−1443
终端 assignments
†
(numerical)
管脚
号码
信号
名字
管脚
号码
信号
名字
管脚
号码
信号
名字
管脚
号码
信号
名字
1 A20 37 DV
DD
73 D15 109 CLKX0
2 V
SS
38 H1 74 D14 110 FSX0
3 A19 39 H3 75 D13 111 DX0
4 A18 40 V
SS
76 D12 112 V
SS
5 A17 41 STRB 77 DV
DD
113 TCLK1
6 DV
DD
42 r/w 78 D11 114 TCLK0
7 A16 43 DV
DD
79 D10 115 DV
DD
8 A15 44 IACK 80 V
SS
116 XF1
9 V
SS
45 RDY 81 D9 117 XF0
10 A14 46 CV
DD
82 D8 118 V
SS
11 A13 47 支撑 83 CV
DD
119 INT3
12 CV
DD
48 HOLDA 84 D7 120 INT2
13 A12 49 V
SS
85 D6 121 INT1
14 A11 50 D31 86 DV
DD
122 INT0
15 DV
DD
51 D30 87 D5 123 CV
DD
16 A10 52 D29 88 D4 124 EDGEMODE
17 A9 53 DV
DD
89 V
SS
125 mcbl/mp
18 V
SS
54 D28 90 D3 126 V
SS
19 A8 55 D27 91 D2 127 重置
20 A7 56 V
SS
92 D1 128 SHZ
21 A6 57 D26 93 D0 129 DV
DD
22 A5 58 D25 94 DV
DD
130 EXTCLK
23 DV
DD
59 D24 95 EMU1 131 PLLV
DD
‡
24 A4 60 DV
DD
96 EMU0 132 XOUT
25 V
SS
61 D23 97 V
SS
133 XIN
26 A3 62 D22 98 TCK 134 PLLV
SS
‡
27 A2 63 V
SS
99 TDO 135 CLKMD1
28 CV
DD
64 D21 100 TDI 136 CLKMD0
29 A1 65 D20 101 CV
DD
137 CV
DD
30 A0 66 CV
DD
102 TMS 138 RSV1
31 DV
DD
67 D19 103 TRST 139 RSV0
32 PAGE3 68 D18 104 DR0 140 V
SS
33 PAGE2 69 DV
DD
105 V
SS
141 A23
34 V
SS
70 D17 106 FSR0 142 A22
35 PAGE1 71 D16 107 CLKR0 143 DV
DD
36 PAGE0 72 V
SS
108 DV
DD
144 A21
†
DV
DD
是 这 电源 供应 为 这 i/o 管脚 当 cv
DD
是 这 电源 供应 为 这 核心 cpu. v
SS
是 这 地面 为 两个都 这 i/o 管脚 和 这 核心
cpu.
‡
PLLV
DD
和 pllv
SS
是 分开的 pll 供应 管脚 那 应当 是 externally 连接 至 cv
DD
和 v
ss,
各自.

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    sprs087e −二月 1999 − 修订 january 2004 5 邮递办公室盒 1443 • houston, 德州 77251−1443 终端 assignments † (numerical) 管脚号码信号名字管脚号码信号名字管脚号码信号名字管脚号码信号名字 1 A20 37 DV DD 73 D15 109 CLKX0 2 V SS 38 H1 74 D14 110 FSX0 3 A19 39 H3 75 D13 111 DX0 4 A18 40 V SS 76 D12 112 V SS 5 A17 41 STRB 77 DV DD 113 TCLK1 6 DV DD 42 r/w 78 D11 114 TCLK0 7 A16 43 DV DD 79 D10 115 DV DD 8 A15 44 IACK 80 V SS 116 XF1 9 V SS 45 RDY 81 D9 117 XF0 10 A14 46 CV DD 82 D8 118 V SS 11 A13 47 支撑 83 CV DD 119 INT3 12 CV DD 48 HOLDA 84 D7 120 INT2 13 A12 49 V SS 85 D6 121 INT1 14 A11 50 D31 86 DV DD 122 INT0 15 DV DD 51 D30 87 D5 123 CV DD 16 A10 52 D29 88 D4 124 EDGEMODE 17 A9 53 DV DD 89 V SS 125 mcbl/mp 18 V SS 54 D28 90 D3 126 V SS 19 A8 55 D27 91 D2 127 重置 20 A7 56 V SS 92 D1 128 SHZ 21 A6 57 D26 93 D0 129 DV DD 22 A5 58 D25 94 DV DD 130 EXTCLK 23 DV DD 59 D24 95 EMU1 131 PLLV DD ‡ 24 A4 60 DV DD 96 EMU0 132 XOUT 25 V SS 61 D23 97 V SS 133 XIN 26 A3 62 D22 98 TCK 134 PLLV SS ‡ 27 A2 63 V SS 99 TDO 135 CLKMD1 28 CV DD 64 D21 100 TDI 136 CLKMD0 29 A1 65 D20 101 CV DD 137 CV DD 30 A0 66 CV DD 102 TMS 138 RSV1 31 DV DD 67 D19 103 TRST 139 RSV0 32 PAGE3 68 D18 104 DR0 140 V SS 33 PAGE2 69 DV DD 105 V SS 141 A23 34 V SS 70 D17 106 FSR0 142 A22 35 PAGE1 71 D16 107 CLKR0 143 DV DD 36 PAGE0 72 V SS 108 DV DD 144 A21 † DV DD 是这电源供应为这 i/o 管脚当 cv DD 是这电源供应为这核心 cpu. v SS 是这地面为两个都这 i/o 管脚和这核心 cpu. ‡ PLLV DD 和 pllv SS 是分开的 pll 供应管脚那应当是 externally 连接至 cv DD 和 v ss, 各自.

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