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资料编号:303007
 
资料名称:ETC5067N
 
文件大小: 270.37K
   
说明
 
介绍:
POWER AMPLIFIER SERIAL INTERFACE CODEC/FILTERWITH RECEIVE
 
 


: 点此下载
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所有 定时 规格
标识 参数 最小值 典型值 最大值 单位
1/t
PM
频率 主控 clocks
MCLK
X
MCLK
R
取决于 设备 使用
BCLK
R
/clksel 管脚
1.536
2.048
1.544
MHz
t
WMH
宽度 主控 时钟 MCLK
X
MCLK
R
160 ns
t
WML
宽度 主控 时钟 MCLK
X
MCLK
R
160 ns
t
RM
上升 时间 主控 时钟 MCLK
X
MCLK
R
50 ns
t
FM
下降 时间 主控 时钟 MCLK
X
MCLK
R
50 ns
t
时期 时钟 485 488 15.725 ns
t
WBH
宽度 时钟 (v
IH
= 2.2 v) 160 ns
t
WBL
宽度 时钟 (v
IL
= 0.6 v) 160 ns
t
RB
上升 时间 时钟 (t
= 488 ns) 50 ns
t
FB
下降 时间 时钟 (t
= 488 ns) 50 ns
t
SBFM
设置-向上 时间 BCLK
X
MCLK
X
下落 边缘.
(第一 时钟 之后 leading 边缘 FS
X
)
100 ns
t
HBF
支持 Time 时钟 框架 同步
(长 框架 仅有的)
0ns
t
SFB
设置-向上 时间 框架 同步 时钟 (长 框架 仅有的) 80 ns
t
HBFI
支撑 时间 3rd 时期 时钟 FS
X
或者 FS
R
框架 同步 (长 框架 仅有的)
100 ns
t
DZF
延迟 时间 有效的 数据 FS
X
或者 BCLK
X
, whichever
comes 后来的 延迟 时间 FSX 数据 输出 无能
(c
L
= 0 pF 150 pf)
20 165 ns
t
DBD
延迟 时间 BCLK
X
数据 有效的
(加载 = 150 pF 2 LSTTL 负载)
0 150 ns
t
DZC
延迟 时间 BCLK
X
数据 输出 无能 50 165 ns
t
SDB
设置-向上 时间 D
R
有效的 BCLK
r/x
50 ns
t
HBD
支撑 时间 BCLK
r/x
D
R
invalid 50 ns
t
支撑
支持 时间 时钟 框架 同步 (短的 框架 仅有的) 0 ns
t
SF
设置-向上 时间 FS
x/r
BCLK
x/r
(短的 框架 同步 脉冲波) - 便条 1
80 ns
t
HF
支撑 时间 BCLK
x/r
FS
x/r
(短的 框架 同步 脉冲波) - 便条 1
100 ns
t
XDP
延迟 时间 TS
X
(加载 = 150 pF 2 LSTTI 负载) 140 ns
t
WFL
最小 宽度 框架 同步 脉冲波 (低 水平的)
(64 位/s 运行 模式)
160 ns
便条 :
1.f或者 短的 frame 同步 德州仪器ming. FS
X
FS
R
必须 go 它们的 respective clocks 高.
图示 1 :
64 k 位/s 定时 图解. (看 next 完全 定时)
ETC5064 - etc5064-x - ETC5067 - etc5067-x
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