UPD720114GA-9EU-A_集成电路资料查询网

数据 薄板  s17462ej2v0ds
7
µ
PD720114
2. 电的  规格
2.1 缓存区 列表
•
 2.5 v 振荡器 接口
x1, x2
•
 5 v tolerant 施密特 输入 缓存区
csb1, vbusm
•
 3.3 v 施密特 输入 缓存区
csb(4:2),总线_b, sysrstb, 测试
•
 3.3 v i
OL
= 12 毫安 输出 缓存区
绿色
•
 3.3 v 输入 和 3.3 v i
OL
= 3 毫安 输出 缓存区
ppb(4:1), led(4:1)
•
 3.3 v 输入 和 i
OL
= 12 毫安 输出 缓存区
AMBER
•
usb2.0 接口
dpu, dmu, dp(4:1), dm(4:1), rref
在之上, “5 v” 谈及 至 一个 3 v 输入 buffer 那 是 5 v tolerant (有 5 v 毫安ximum 输入 电压). 因此, 它 是
可能 至 有 一个 5 v 连接 为 一个 外部 总线.

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数据薄板 s17462ej2v0ds 7 µ PD720114 2. 电的规格 2.1 缓存区列表 • 2.5 v 振荡器接口 x1, x2 • 5 v tolerant 施密特输入缓存区 csb1, vbusm • 3.3 v 施密特输入缓存区 csb(4:2),总线_b, sysrstb, 测试 • 3.3 v i OL = 12 毫安输出缓存区绿色 • 3.3 v 输入和 3.3 v i OL = 3 毫安输出缓存区 ppb(4:1), led(4:1) • 3.3 v 输入和 i OL = 12 毫安输出缓存区 AMBER • usb2.0 接口 dpu, dmu, dp(4:1), dm(4:1), rref 在之上, “5 v” 谈及至一个 3 v 输入 buffer 那是 5 v tolerant (有 5 v 毫安ximum 输入电压). 因此, 它是可能至有一个 5 v 连接为一个外部总线.

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