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资料编号:304695
 
资料名称:MAX132EWG
 
文件大小: 129.26K
   
说明
 
介绍:
【18-Bit ADC with Serial Interface
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
MAX132
±18-位 模数转换器 和 串行 接口
4 _______________________________________________________________________________________
__________________________________________典型 运行 特性
-0.30
-0.25
-0.20
-0.15
-0.10
-0.05
0.05
0
错误 vs. 一般-mode
输入 电压 (v
lo–agnd)
max132-01
一般模式 电压 (v)
-3 -2 -1 0 1 2 3 4-4
错误 (% 的 fsr)
在 hi = 在 lo
0
0 0.5 1.5
50hz/60hz 读-零 offset
vs. vref
1.5
3.5
max132-02
vref (v)
读-零 补偿 (% 的 fsr)
1.0 2.0
2.5
4.0
1.0
0.5
3.0
2.0
4.5
60hz 模式
50hz 模式
0
-40 -20 20
50hz/60hz 读-零 offset
vs. 温度
0.6
1.4
max132-03
温度 (°c)
0 40 60 80 100
1.0
1.6
0.4
0.2
1.2
0.8
读-零 补偿 (% 的 fsr)
60hz 模式, vref = 545mv
50hz 模式, vref = 655mv
-40
0 50 150
供应 current
vs. 结晶 频率
20
100
max132-04
结晶 频率 (khz)
供应 电流 (
µ
一个)
100 200 250 300 350
60
120
0
-20
80
40
140
v-
V+
0.10
0.08
0.06
0.04
0.02
0
全部-规模 rollover error
vs. vref
max132-05
vref (v)
0 0.5 1.0 1.5 2.52.0
rollover 错误 (% 的 fsa)
0
5
10
15
20
噪音 vs. number
的 样本 averaged
max132-06
号码 的 样本 averaged
0102030 5040
噪音 (
µ
V
RMS
)
______________________________________________________________管脚 描述
振荡器 输出 2 是 正常情况下 连接 至 一个 32,768hz 结晶. 做 不 连接 和 外部 时钟 源.osc25
串行 时钟 输入. 在 sclk’s rising 边缘, 数据 是 shifted 在 这 内部的 变换 寄存器 通过 din. 在
sclk’s 下落 边缘, 数据 是 clocked 输出 的 dout.
SCLK4
串行 数据 输出, d7 第一 位 输出. 数据 是 clocked 输出 在 这 下落 边缘 的 sclk. 高 阻抗 当csis 高.DOUT3
用户-可编程序的 输出 位 1—programmed 通过 这 串行 端口.p18
用户-可编程序的 输出 位 0—programmed 通过 这 串行 端口.p07
振荡器 输入 1 是 正常情况下 连接 至 一个 32,768hz 结晶, 或者 将 是 连接 至 一个 外部 时钟.osc16
串行 数据 在, d7 第一 位 在. 数据 是 clocked 在 这 寄存器 在 这 rising 边缘 的 sclk.din2
管脚
碎片 选择 输入 有 3 功能: 1) 当 低, 选择 ic 为 交流; 2) 在 rising edge, 负载
输入 变换 寄存器 数据 在 一个 的 这 command 寄存器; 3) 在 下落 边缘, 负载 数据 从 一个 的 这
输出 寄存器 在 这 输出 变换 寄存器. 当 cs 是 高, dout 是 高 阻抗.
CS1
FUNCTIONNAME
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