74F374_集成电路资料查询网

单位 LoadingFan 输出
管脚
54F74F
Names
描述
UL 输入 I
IH
I
IL
HIGHLOW 输出 I
OH
I
OL
D
0
–D
7
数据 输入 1010 20
m
A
b
06 毫安
CP 时钟 脉冲波 输入 (起作用的 Rising 边缘) 1010 20
m
A
b
06 毫安
OE
触发-状态 输出 使能 输入 (起作用的 低) 1010 20
m
A
b
06 毫安
O
0
–O
7
触发-状态 输出 15040 (333)
b
3 mA24 毫安 (20 毫安)
函数的 描述
这 ’F374 组成 的 第八 边缘-triggered flip-flops 和 在-
dividual d-类型 输入 和 触发-状态 真实 outputs 这
缓冲 时钟 和 缓冲 输出 使能 是 一般 至
所有 flip-flops 这 第八 flip-flops 将 store 这 状态 的 它们的
单独的 D 输入 那 满足 这 建制 和 支撑 时间 re-
quirements 在 这 低-至-高 时钟 (cp) transition 和
这 输出 使能 (oe
) LOW 这 内容 的 这 第八 flip-
flops 是 有 在 这 outputs 当 这 OE
是 HIGH 这
输出 go 至 这 高 阻抗 state 运作 的 这
OE
输入 做 不 影响 这 状态 的 这 flip-flops
真实 表格
输入 内部的 输出
D
n
CP OE
寄存器
O
n
H
L
LH H
L
L
LL L
XXH X Z
H
e
高 电压 水平的
L
e
低 电压 水平的
X
e
不重要
Z
e
高 阻抗
L
e
低-至-高 时钟 转变
逻辑 图解
TLF9524–5
请 便条 那 这个 图解 是 提供 仅有的 为 这 understanding 的 逻辑 行动 和 应当 不 是 使用 至 估计 传播 delays
2

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单位 LoadingFan 输出管脚 54F74F Names 描述 UL 输入 I IH I IL HIGHLOW 输出 I OH I OL D 0 –D 7 数据输入 1010 20 m A b 06 毫安 CP 时钟脉冲波输入 (起作用的 Rising 边缘) 1010 20 m A b 06 毫安 OE 触发-状态输出使能输入 (起作用的低) 1010 20 m A b 06 毫安 O 0 –O 7 触发-状态输出 15040 (333) b 3 mA24 毫安 (20 毫安) 函数的描述这 ’F374 组成的第八边缘-triggered flip-flops 和在- dividual d-类型输入和触发-状态真实 outputs 这缓冲时钟和缓冲输出使能是一般至所有 flip-flops 这第八 flip-flops 将 store 这状态的它们的单独的 D 输入那满足这建制和支撑时间 re- quirements 在这低-至-高时钟 (cp) transition 和这输出使能 (oe ) LOW 这内容的这第八 flip- flops 是有在这 outputs 当这 OE 是 HIGH 这输出 go 至这高阻抗 state 运作的这 OE 输入做不影响这状态的这 flip-flops 真实表格输入内部的输出 D n CP OE 寄存器 O n H L LH H L L LL L XXH X Z H e 高电压水平的 L e 低电压水平的 X e 不重要 Z e 高阻抗 L e 低-至-高时钟转变逻辑图解 TLF9524–5 请便条那这个图解是提供仅有的为这 understanding 的逻辑行动和应当不是使用至估计传播 delays 2

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