1997 Oct 21 8
飞利浦 半导体 产品 规格
I
2
c-总线 控制
PCF8584
6.3 设置-向上 寄存器 s0', s2 和 s3
寄存器 s0', s2 和 s3 是 使用 为 initialization 的 这
pcf8584 (看 图.5 ‘initialization sequence’ flowchart).
6.4 自己的 地址 寄存器 s0'
当 这 pcf8584 是 addressed 作 从动装置, 这个 寄存器
必须 是 承载 和 这 7-位 i
2
c-总线 地址 至 这个 这
pcf8584 是 至 respond. 在 initialization, 这 自己的
地址 寄存器 s0' 必须 是 写 至, regardless
whether 它 是 后来的 使用. 这 addressed 作 从动装置 (aas) 位
在 状态 寄存器 s1 是 设置 当 这个 地址 是 received
(这 值 在 s0 是 对照的 和 这 值 在 s0'). 便条
那 这 s0 和 s0' 寄存器 是 补偿 用 一个 位; hence,
程序编制 这 自己的 地址 寄存器 s0' 和 一个 值 的
55h 将 结果 在 这 值 aah 正在 公认的 作 这
pcf8584’s 从动装置 地址 (看 图.1).
程序编制 的 s0' 是 accomplished 通过 这 并行的-总线
当 a0 是 低, 和 这 适合的 位 结合体 设置
在 控制 状态 寄存器 s1 (s1 是 写 当
管脚 A0 = 高). 位 结合体 为 accessing 所有
寄存器 是 给 在 表格 5. 之后 重置, s0' 有 default
地址 00h (pcf8584 是 因此 initially 在 监控 模式,
看 部分 6.12.3).
6.5 时钟 寄存器 S2
寄存器 s2 提供 控制 在 碎片 时钟 频率
和 scl 时钟 频率. s20 和 s21 提供 一个 选择
的 4 不同的 i
2
c-总线 scl 发生率 这个 是 显示 在
表格 2. 便条 那 这些 scl 发生率 是 仅有的
得到 当 位 s24, s23 和 s22 是 编写程序 至
这 准确无误的 输入 时钟 频率 (f
clk
).
表格 2
寄存器 s2 选择 的 scl 频率
s22, s23 和 s24 是 使用 为 控制 的 这 内部的 时钟
预分频器. 预定的 至 这 possibility 的 varying 微控制器
时钟 信号, 这 预分频器 能 是 编写程序 至 adapt
至 5 不同的 时钟 比率, 因此 供应 一个 常量 内部的
时钟. 这个 是 必需的 至 提供 一个 稳固的 时间 根基 为 这
scl 发生器 和 这 数字的 过滤 有关联的 和 这
I
2
c-总线 信号 scl 和 sda. 选择 为 adaption 至
外部 时钟 比率 是 显示 在 表格 3.
位
近似的 scl
频率 f
SCL
(khz)
S21 S20
00 90
01 45
10 11
1 1 1.5
程序编制 的 s2 是 accomplished 通过 这 并行的-总线
当 a0 = 低, 和 这 适合的 位 结合体 设置
在 控制 状态 寄存器 s1 (s1 是 写 当
A0 = 高). 位 结合体 为 accessing 所有 寄存器
是 给 在 表格 5.
表格 3
寄存器 s2 选择 的 时钟 频率
便条
1. X = don’t 小心.
6.6 中断 vector S3
这 中断 vector 寄存器 提供 一个 8-位
用户-可编程序的 vector 为 vectored-中断
微控制器. 这 vector 是 sent 至 这 总线 端口
(db7 至 db0) 当 一个 中断 acknowledge 信号 是
asserted 和 这 eni (使能 中断) 标记 是 设置. default
vector 值 是:
•
vector 是 ‘00h’ 在 80xx 模式
•
vector 是 ‘0fh’ 在 68000 模式.
在 重置 这 pcf8584 是 在 这 80xx 模式, 因此 这
default 中断 vector 是 ‘00h’.
6.7 数据 变换 寄存器/读 缓存区 s0
寄存器 s0 acts 作 串行 变换 寄存器 和 读 缓存区
接合 至 这 i
2
c-总线. 所有 读 和 写 行动
至/从 这 i
2
c-总线 是 完毕 通过 这个 寄存器. s0 是 一个
结合体 的 一个 变换 寄存器 和 一个 数据 缓存区; 并行的
数据 是 总是 写 至 这 变换 寄存器, 和 读 从
这 数据 缓存区. i
2
c-总线 数据 是 总是 shifted 在 或者 输出 的
变换 寄存器 s0.
内部的 时钟 频率
S24 S23 S22 f
clk
(mhz)
0X
(1)
X
(1)
3
1 0 0 4.43
1016
1108
11112
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