飞利浦 半导体
ISP1181B
全部-速 usb 附带的 控制
产品 数据 rev. 02 — 07 12月 2004 7 的 70
9397 750 13958
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DATA5 31 26 i/o 位 5 的 d[15:0]; 双向的 数据 线条
(回转-比率 控制 输出, 4 毫安)
DATA4 32 27 i/o 位 4 的 d[15:0]; 双向的 数据 线条
(回转-比率 控制 输出, 4 毫安)
DATA3 33 28 i/o 位 3 的 d[15:0]; 双向的 数据 线条
(回转-比率 控制 输出, 4 毫安)
DATA2 34 29 i/o 位 2 的 d[15:0]; 双向的 数据 线条
(回转-比率 控制 输出, 4 毫安)
DATA1 35 30 i/o 位 1 的 d[15:0]; 双向的 数据 线条
(回转-比率 控制 输出, 4 毫安)
地 36 31 - 地面 供应
V
cc(3.3)
37 32 - 供应 电压 (3.0 V 至 3.6 v); leave 这个
管脚 unconnected 当 使用 v
CC
= 5.0 v
AD0 38 33 i/o 多路复用 双向的 地址 和 数据
线条; 代表 地址 a0 或者 位 0 的
d[15:0] 在 conjunction 和 输入 ale;
水平的-敏感的 输入 或者 回转-比率 控制
输出 (4 毫安)
地址 阶段
: 一个 高-至-低 转变
在 输入 ALE latches 这 水平的 在 这个 管脚 作
地址 a0 (1 = command, 0 = 数据)
数据 阶段
: 在 读 这个 管脚 输出
位 d[0]; 在 writing 这 水平的 在 这个 管脚 是
latched 作 位 d[0]
A0 39 34 I 地址 输入; 选择 command (a0 = 1) 或者
数据 (a0 = 0); 在 一个 多路复用 地址/数据
总线 configuration 这个 管脚 是 不 使用 和
必须 是 系 低 (连接 至 地)
RD 40 35 I 读 strobe 输入
WR 41 36 I 写 strobe 输入
ALE 42 37 I 地址 获得 使能 输入; 一个 高-至-低
转变 latches 这 水平的 在 管脚 ad0 作
地址 信息 在 一个 多路复用
地址/数据 总线 configuration; 必须 是
系 低 (连接 至 地) 为 一个 独立的
地址/数据 总线 configuration
CS 43 38 I 碎片 选择 输入
重置 44 39 I 重置 输入 (施密特 触发); 一个 低 水平的
生产 一个 异步的 重置; 连接
至 v
CC
为 电源-在 重置 (内部的 por
电路)
CLKOUT 45 40 O 可编程序的 时钟 输出 (2 毫安)
表格 2: 管脚 描述
…continued
标识
[1]
管脚 类型 描述
TSSOP48 HVQFN48
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