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资料编号:44637
 
资料名称:AD9883AKST-140
 
文件大小: 229.71K
   
说明
 
介绍:
110 MSPS/140 MSPS Analog Interface for Flat Panel Displays
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
rev. b
AD9883A
–10–
那 要点 这 信号 应当 是 resistively terminated (75
至 这 信号 地面 返回) 和 capacitively 结合 至 这
AD9883A输入 通过 47 nf 电容. 这些 电容
表格 部分 的 这 直流 restoration 电路.
在 一个 完美的 world 的 perfectly matched 阻抗, 这 最好的 perfor-
mance 能 是 得到 和 这 最宽的 可能 信号 带宽.
这 ultrawide 带宽 输入 的 这 ad9883a (300 mhz)
追踪 这 输入 信号 continuously 作 它 moves 从 一个 pixel
水平的 至这 next, 和 digitize 这 pixel 在 一个 长, flat pixel
time. 在 许多 系统, 不管怎样, 那里 是 mismatches, reflections,
和 噪音, 这个 能 结果 在 过度的 ringing 和 扭曲量 的
这 输入 波形. 这个 制造 它 更多 difficult 至 establish 一个
抽样 阶段 那 提供 好的 image 质量. 它 有 被
显示 那 一个 小 inductor 在 序列 和 这 输入 是 effective 在
rolling 止 这 输入 带宽 slightly 和 供应 一个 高
质量 信号 在 一个 wider 范围 的 情况. 使用 一个 fair-
rite #2508051217z0 高 速 信号 碎片 beadinductor
在 这 电路 的 图示 1 给 好的 结果 在 大多数 产品.
RGB
输入
R
AIN
G
AIN
B
AIN
47nF
75
图示 1. 相似物 输入 接口 电路
hsync, vsync 输入
这 接口 也 takes 一个 horizontal 同步 信号, 这个 是 使用
至 发生 这 pixel 时钟 和 clamp 定时. 这个 能 是 也
一个 同步 信号 直接地 从这 graphics 源, 或者 一个 preprocessed
ttl 或者 cmos 水平的 信号.
这 hsync 输入 包含 一个 施密特 触发 缓存区 为 免除
至 噪音 和 信号 和 长 上升 时间. 在 典型 pc 为基础
graphic 系统, 这 同步 信号 是 simply ttl-水平的 驱动器
feeding unshielded 线 在 这 监控 缆索. 作 此类, 非 ter-
mination 是 必需的.
串行 控制 端口
这 串行 控制 端口 是 设计 为 3.3 v 逻辑. 如果 那里 是 5 v
驱动器 在 这 总线, 这些 管脚 应当 是 保护 和 150
序列
电阻器 放置 在 这 拉-向上 电阻器 和 这 输入 管脚.
输出 信号 处理
这 数字的 输出 是 设计 和 指定 至 运作 从 一个
3.3 v 电源 供应 (v
DD
). 它们 能 也 工作 和 一个 v
DD
低 作 2.5 v 为 兼容性 和 其它 2.5 v 逻辑.
夹紧
rgb 夹紧
合适的 digitize 这 新当选的 信号, 这 直流 补偿 的 这 输入
必须 是调整 至 合适 这 范围 的 这 在-board 一个/d 转换器.
大多数 graphics 系统 生产 rgb 信号 和 黑色 在地面
和 白 在 大概 0.75 v. 不管怎样, 如果 同步信号
是 embedded 在 这 graphics, 这 同步 tip 是 常常 在 地面
和 黑色 是 在 300 mv. 然后 白 是 在 大概 1.0 v.
一些 一般 rgb 线条 放大器boxes 使用 发射级-追随着
缓存区 至 分割 信号 和 增加 驱动 能力. 这个 intro-
duces 一个 700 mv 直流 补偿 至 这 信号, 这个 必须 是 移除
为 恰当的 俘获 用 这 ad9883a.
这 关键 至 夹紧 是 至 identify 一个 portion (时间) 的 这 信号
当 这 graphic 系统 是 知道 至 是 producing 黑色. 一个
offset 是 然后 introduced 这个 结果 在 这 一个/d converters
producing 一个 黑色 输出 (代号 00h) 当 这 知道 黑色
输入 是 呈现. 这 补偿 然后 仍然是 在 放置 当 其它
信号 水平 是 processed, 和 这 全部 信号 是 shifted 至 elimi-
nate 补偿 errors.
在 大多数 pc graphics 系统, 黑色 是 transmitted 在
起作用的 video 线条. 和 crt 显示, 当 这 electron beam
有 完成 writing 一个 horizontal 线条 在 这 screen (在 这
正确的 一侧), 这 beam 是 deflected quickly 至 这 left 一侧 的 这
screen (called horizontal retrace) 和 一个 黑色 信号 是 提供
至 阻止 这 beam 从 disturbing 这 image.
系统 和 embedded 同步, 一个 blacker-比-黑色 信号
(hsync) 是生产 briefly 至 信号 这 crt 那 它 是 时间 至
begin 一个 retrace. 为 obvious reasons, 它 是 重要的 至 避免
夹紧 在 这 tip 的 hsync. fortunately, 那里 是 virtually
总是 一个 时期 下列的 hsync, called 这 后面的 porch, 在哪里 一个
好的 黑色 涉及 是 提供. 这个 是 这 时间 当 clamp-
ing 应当 是 完毕.
这 clamp 定时 能 是 established 用 simply exercising 这
clamp 管脚 在 这 适合的 时间 (和 外部 clamp = 1).
这 极性 的 这个 信号 是 设置 用 这 clamp 极性 位.
一个 simpler 方法 的 clamp 定时 雇用 这 ad9883a 内部的
clamp 定时 发生器. 这 clamp placement 寄存器 是 pro-
grammed 和 这 号码 的 pixel 时间 那 应当 通过 之后
这 trailing 边缘 的 hsync 在之前 夹紧 开始. 一个 second
寄存器 (clamp 持续时间) sets 这 持续时间 的 这 clamp. 这些
是 两个都 8-位 值, 供应 considerable flexibility 在 clamp
一代. 这 clamp 定时 是 关联 至 这 trailing 边缘
的 hsync 因为, though hsync 持续时间 能 相异 widely, 这
后面的 porch (黑色 涉及) 总是 跟随 hsync. 一个 好的
开始 要点 为 establishing 夹紧 是 至 设置 这 clamp 放置-
ment 至 09h (供应 9 pixel 时期 为 这 graphics 信号 至
stabilize 之后 同步) 和 设置 这 clamp 持续时间 至 14h (给
这 clamp 20 pixel 时期 至 reestablish 这 黑色 涉及).
夹紧 是 accomplished 用 放置 一个 适合的 承担 在
这 外部 输入 连接 电容. 这 值 的 这个 capaci-
tor affects 这 效能 的 这 clamp. 如果 它 是 too 小, 那里
将 是 一个 重大的 振幅 改变 在 一个 horizontal 线条
时间 (在 夹紧 间隔). 如果 这 电容 是 too 大,
然后 它 将 引领 excessively 长 为 这 clamp 至 recover 从 一个
大 改变 在 新当选的 信号 补偿. 这 推荐 值
(47 nf) 结果 在 recovering 从 一个 步伐 错误 的 100 mv 至
在里面 1/2 lsb 在 10 线条 和 一个 clamp 持续时间 的 20 pixel
时期 在 一个 60 hz sxga 信号.
yuv 夹紧
yuv graphic 信号 是 slightly 不同的 从 rgb 信号 在
那 这 直流 涉及 水平的 (黑色 水平的 在 rgb 信号) 能 是 在
这 中点 的 这 graphics 信号 相当 比 在 这 bottom.
为 这些 信号, 它 能 是 需要 至 clamp 至 这 midscale
范围 的 这 一个/d 转换器 范围 (80h) 相当 比 在 这 bottom
的 这 一个/d 转换器 范围 (00h).
夹紧 至 midscale 相当 比 至 地面 能 是 accomplished
用 设置 这 clamp 选择 位 在 这 串行 总线 寄存器. 各自 的
这 三 转换器 有 它的 自己的 选择 位 所以 那 它们 能 是
clamped 至 也 midscale 或者 地面 independently. 这些
位 是 located 在 寄存器 10h 和 是 位 0–2. 这midscale
谈及ence 电压 那 各自 一个/d 转换器 clamps 至 是 提供
在 这 midscv 管脚, (管脚 37). 这个 管脚 应当 是 绕过 至
地面 和 一个 0.1
µ
f 电容, (甚至 如果 midscale 夹紧 是 不
required).
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