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资料编号:474419
 
资料名称:MC100EP016A
 
文件大小: 98.94K
   
说明
 
介绍:
3.3 V ECL 8-Bit Synchronous Binary Up Counter
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
MC100EP016A
http://onsemi.com
2
V
EE
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26
27
28
29
30
31
32
15
14
13
12
11
10
9
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24 23 22 21 20 19 18 17
16
MC100EP016A
COUT
COUT
TC
V
CC
P7
P6
P5
V
CC
Q2
Q1
Q0
V
EE
MR
CE
PE
V
CC
TCLDQ7Q6Q5Q4V
CC
P4P3P2P1P0CLKV
BB
CLK
图示 1. 32−lead lqfp 引脚
(顶 视图)
Q3
警告: 所有 v
CC
和 v
EE
管脚 必须 是 externally 连接 至
电源 供应 至 保证 恰当的 运作.
管脚 描述
管脚
P0−P7*
Q0−Q7 ecl 数据 输出
函数
ecl 并行的 数据 (preset) 输入
CE*
PE
* ecl 并行的 加载 使能 控制 输入
ecl 计数 使能 控制 输入
MR*
clk*, clk* ecl 差别的 时钟
ecl 主控 重置
TC
TCLD* ecl tc−load 控制 输入
ecl 终端 计数 输出
cout, cout
V
CC
积极的 供应
ecl 差别的 输出
V
EE
V
BB
涉及 电压 输出
负的 供应
* 管脚 将 default 低 当 left 打开.
zz = 时钟 脉冲波 (high−to−low)
z = 时钟 脉冲波 (low−to−high)
CE 函数
X
L
L
H
X
X
加载 并行的 (pn 至 qn)
持续的 计数
计数; 加载 并行的 在 tc
= 低
支撑
masters respond, slaves 支撑
重置 (qn : = 低, tc
: = 高)
函数 tables
PE
L
H
H
H
X
X
TCLD
X
L
H
X
X
X
MR
L
L
L
L
L
H
CLK
Z
Z
Z
Z
ZZ
X
函数 表格
函数 PE CE MR TCLD CLK P7−P4 P3 P2 P1 P0 Q7−Q4 Q3 Q2 Q1 Q0 TC COUT COUT
加载 计数 L
H
H
H
H
X
L
L
L
L
L
L
L
L
L
X
L
L
L
L
Z
Z
Z
Z
Z
H
X
X
X
X
H
X
X
X
X
H
X
X
X
X
L
X
X
X
X
L
X
X
X
X
H
H
H
H
L
H
H
H
H
L
H
H
H
H
L
L
L
H
H
L
L
H
L
H
L
H
H
H
L
H
H
H
H
L
H
L
L
L
H
L
加载 支撑 L
H
H
X
H
H
L
L
L
X
X
X
Z
Z
Z
H
X
X
H
X
X
H
X
X
L
X
X
L
X
X
H
H
H
H
H
H
H
H
H
L
L
L
L
L
L
H
H
H
H
H
H
L
L
L
加载 在
终端
计数
H
H
H
H
H
H
L
L
L
L
L
L
L
L
L
L
L
L
H
H
H
H
H
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Z
Z
Z
Z
Z
Z
H
H
H
H
H
H
L
L
L
L
L
L
H
H
H
H
H
H
H
H
H
H
H
H
L
L
L
L
L
L
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H
H
H
H
H
H
H
H
L
L
H
H
H
H
H
H
L
L
H
H
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H
L
H
L
H
L
H
L
H
H
L
H
H
H
H
H
L
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H
H
L
L
H
L
L
L
重置 X X H X X X X X X X L L L L L H H L
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