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图示 11. 模式 控制 文字 图示 12. 模式 2
便条: 任何 sequence 在哪里 wr occurs 在之前 ack 和 stb occurs 在之前 rd 是 容许的. (intr = ibf
•
掩饰
•
STB
•
RD
÷
OBF
•
掩饰
•
ACK
•
wr)
图示 13. 模式 2 (bi-directional)
1
D7
D6 D5 D4 D3 D2 D1 D0
控制 文字
1/0 1/01 1/0
pc2-pc0
1 = 输入
0 = 输出
端口 b
1 = 输入
0 = 输出
组 b 模式
0 = 模式 0
1 = 模式 1
PC7
OBFA
PC6
INTE
pa7-pa0
ACKA
IBFA
PC4
WR
INTE
RD
PC3
PC5
pc2-pc0
1
2
8
STBA
3
i/o
INTRA
tWOB
tAOB
tAK
tAD
tKD
tPH
tPS
tSIB
tST
OBF
WR
INTR
ACK
IBF
STB
附带的
总线
RD
tRIB
数据 从
附带的 至 82c55a
数据 从
82c55a 至 附带的
数据 从
82c55a 至 cpu
数据 从
cpu 至 82c55a
82C55A

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11 图示 11. 模式控制文字图示 12. 模式 2 便条: 任何 sequence 在哪里 wr occurs 在之前 ack 和 stb occurs 在之前 rd 是容许的. (intr = ibf • 掩饰 • STB • RD ÷ OBF • 掩饰 • ACK • wr) 图示 13. 模式 2 (bi-directional) 1 D7 D6 D5 D4 D3 D2 D1 D0 控制文字 1/0 1/01 1/0 pc2-pc0 1 = 输入 0 = 输出端口 b 1 = 输入 0 = 输出组 b 模式 0 = 模式 0 1 = 模式 1 PC7 OBFA PC6 INTE pa7-pa0 ACKA IBFA PC4 WR INTE RD PC3 PC5 pc2-pc0 1 2 8 STBA 3 i/o INTRA tWOB tAOB tAK tAD tKD tPH tPS tSIB tST OBF WR INTR ACK IBF STB 附带的总线 RD tRIB 数据从附带的至 82c55a 数据从 82c55a 至附带的数据从 82c55a 至 cpu 数据从 cpu 至 82c55a 82C55A

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