N80C51BH_集成电路资料查询网

AUTOMOTIVE 80C31BH80C51BH87C51
EXPLANATION 的 这 交流 SYMBOLS
各自 定时 标识 有 5 characters 这 第一 char-
acter 是 总是 一个 ‘T’ (stands 为 时间) 这 其它
characters 取决于 在 它们的 positions 保卫 为
这 名字 的 一个 信号 或者 这 logical 状态 的 那
signal 这 下列的 是 一个 列表 的 所有 这 characters 和
what 它们 保卫 for
AAddress
CClock
DInput data
HLogic 水平的 HIGH
IInstruction (程序 记忆 内容)
LLogic 水平的 LOW 或者 ALE
PPSEN

QOutput data
RRD
signal
TTime
VValid
WWR
signal
XNo 变长 一个 有效的 逻辑 level
ZFloat
为 example
T
AVLL
e
时间 从 地址 有效的 至 ALE Low
T
LLPL
e
时间 从 ALE 低 至 PSEN Low
交流 CHARACTERISTICS
(t
一个
eb
40

Cto
一个
125

C V
CC
e
5V
g
10% (5v
g
20% 非易失存储器 仅有的)
V
SS
e
0V 加载 电容 为 端口 0 ALE 和 PSEN
e
100 pF 加载 电容 为 所有 其它
输出
e
80 pf)
外部 程序 和 数据 记忆 特性
标识 参数
12 MHz Osc 能变的 振荡器
单位
最小值 最大值 最小值 最大值
1T
CLCL
振荡器 频率 MHz
87C5180C51BH80C31BH 35 12–16
T
LHLL
ALE 脉冲波 宽度 127 2T
CLCL
b
40 ns
T
AVLL
地址 有效的 至 ALE 低 28 T
CLCL
b
55 ns
T
LLAX
地址 支撑 之后 ALE 低 48 T
CLCL
b
35 ns
T
LLIV
ALE 低 至 有效的 Instr 在 224 4T
CLCL
b
110 ns
T
LLPL
ALE 低 至 PSEN 低 43 T
CLCL
b
40 ns
T
PLPH
PSEN 脉冲波 宽度 205 3T
CLCL
b
45 ns
T
PLIV
PSEN 低 至 有效的 Instr 在 135 3T
CLCL
b
115 ns
T
PXIX
输入 Instr 支撑 之后 PSEN 00 ns
T
PXIZ
输入 Instr Float 之后 PSEN 59 T
CLCL
b
25 ns
T
AVIV
地址 有效的 至 有效的 Instr 在 312 5T
CLCL
b
105 ns
T
PLAZ
PSEN 低 至 地址 Float 10 10 ns
T
RLRH
RD
脉冲波 宽度 400 6T
CLCL
b
100 ns
T
WLWH
WR 脉冲波 宽度 400 6T
CLCL
b
100 ns
T
RLDV
RD 低 至 有效的 数据 在 252 5T
CLCL
b
165 ns
T
RHDX
数据 支撑 之后 RD 高 0 0 ns
T
RHDZ
数据 Float 之后 RD 高 97 2T
CLCL
b
70 ns
T
LLDV
ALE 低 至 有效的 数据 在 517 8T
CLCL
b
150 ns
T
AVDV
地址 有效的 至 有效的 数据 在 585 9T
CLCL
b
165 ns
T
LLWL
ALE 低 至 RD 或者 WR 低 200 300 3T
CLCL
b
50 3T
CLCL
一个
50 ns
T
AVWL
地址 有效的 至 RD 或者 WR 低 203 4T
CLCL
b
130 ns
T
QVWX
数据 有效的 至 WR 转变 23 T
CLCL
b
60 ns
T
WHQX
数据 支撑 之后 WR 高 33 T
CLCL
b
50 ns
T
RLAZ
RD 低 至 地址 Float 0 0 ns
T
WHLH
RD 或者 WR 高 至 ALE 高 43 123 T
CLCL
b
40 T
CLCL
一个
40 ns
10

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AUTOMOTIVE 80C31BH80C51BH87C51 EXPLANATION 的这交流 SYMBOLS 各自定时标识有 5 characters 这第一 char- acter 是总是一个 ‘T’ (stands 为时间) 这其它 characters 取决于在它们的 positions 保卫为这名字的一个信号或者这 logical 状态的那 signal 这下列的是一个列表的所有这 characters 和 what 它们保卫 for AAddress CClock DInput data HLogic 水平的 HIGH IInstruction (程序记忆内容) LLogic 水平的 LOW 或者 ALE PPSEN  QOutput data RRD signal TTime VValid WWR signal XNo 变长一个有效的逻辑 level ZFloat 为 example T AVLL e 时间从地址有效的至 ALE Low T LLPL e 时间从 ALE 低至 PSEN Low 交流 CHARACTERISTICS (t 一个 eb 40  Cto 一个 125  C V CC e 5V g 10% (5v g 20% 非易失存储器仅有的) V SS e 0V 加载电容为端口 0 ALE 和 PSEN e 100 pF 加载电容为所有其它输出 e 80 pf) 外部程序和数据记忆特性标识参数 12 MHz Osc 能变的振荡器单位最小值最大值最小值最大值 1T CLCL 振荡器频率 MHz 87C5180C51BH80C31BH 35 12–16 T LHLL ALE 脉冲波宽度 127 2T CLCL b 40 ns T AVLL 地址有效的至 ALE 低 28 T CLCL b 55 ns T LLAX 地址支撑之后 ALE 低 48 T CLCL b 35 ns T LLIV ALE 低至有效的 Instr 在 224 4T CLCL b 110 ns T LLPL ALE 低至 PSEN 低 43 T CLCL b 40 ns T PLPH PSEN 脉冲波宽度 205 3T CLCL b 45 ns T PLIV PSEN 低至有效的 Instr 在 135 3T CLCL b 115 ns T PXIX 输入 Instr 支撑之后 PSEN 00 ns T PXIZ 输入 Instr Float 之后 PSEN 59 T CLCL b 25 ns T AVIV 地址有效的至有效的 Instr 在 312 5T CLCL b 105 ns T PLAZ PSEN 低至地址 Float 10 10 ns T RLRH RD 脉冲波宽度 400 6T CLCL b 100 ns T WLWH WR 脉冲波宽度 400 6T CLCL b 100 ns T RLDV RD 低至有效的数据在 252 5T CLCL b 165 ns T RHDX 数据支撑之后 RD 高 0 0 ns T RHDZ 数据 Float 之后 RD 高 97 2T CLCL b 70 ns T LLDV ALE 低至有效的数据在 517 8T CLCL b 150 ns T AVDV 地址有效的至有效的数据在 585 9T CLCL b 165 ns T LLWL ALE 低至 RD 或者 WR 低 200 300 3T CLCL b 50 3T CLCL 一个 50 ns T AVWL 地址有效的至 RD 或者 WR 低 203 4T CLCL b 130 ns T QVWX 数据有效的至 WR 转变 23 T CLCL b 60 ns T WHQX 数据支撑之后 WR 高 33 T CLCL b 50 ns T RLAZ RD 低至地址 Float 0 0 ns T WHLH RD 或者 WR 高至 ALE 高 43 123 T CLCL b 40 T CLCL 一个 40 ns 10

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