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资料编号:511087
 
资料名称:NB6L16DR2G
 
文件大小: 117.47K
   
说明
 
介绍:
2.5V / 3.3V Multilevel Input to Differential LVPECL/LVNECL Clock or Data Receiver/Driver/Translator Buffer
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
NB6L16
http://onsemi.com
9
图示 9. 交流 涉及 度量
D
D
Q
Q
t
PHL
t
PLH
V
INPP
(d) = v
IH
(d) − v
IL
(d)
V
INPP
(d) = v
IH
(d) − v
IL
(d)
V
OUTPP
(q) = v
OH
(q) − v
OL
(q)
V
OUTPP
(q) = v
OH
(q) − v
OL
(q)
D
V
th
D
V
th
图示 10. 差别的 输入 驱动
Single−Ended
D
D
图示 11. 差别的 输入 驱动
Differentially
V
IHmax
V
ILmax
V
IHTYP
V
thTYP
V
ILTYP
V
IHmin
V
ILmin
V
CC
V
thmax
V
thmin
V
th
V
IHDmax
V
ILDmax
V
IHDmin
V
ILDmin
V
IHDtyp
V
ILDtyp
V
ID
= v
IHD
− v
ILD
V
CMR
V
CC
V
CMmax
V
CMmax
图示 12. v
th
图解 图示 13. v
CMR
图解
图示 14. 典型 末端 为 输出 驱动器 和 设备 evaluation
(看 应用 便条 and8020/d − 末端 的 ecl 逻辑 设备.)
驱动器
设备
接受者
设备
QD
Q D
Z
o
= 50
Z
o
= 50
50
50
V
TT
V
TT
= v
CC
− 2.0 v
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