nbc12430, nbc12430a
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这 下列的 给 一个 brief 描述 的 这 符合实际 的 这 nbc12430 和 nbc12430a 输入 和 输出. 除非
explicitly陈述, 所有 输入 是 cmos/ttl 兼容 和 也 pullup 或者 pulldown 电阻器. 这 pecl 输出 是 有能力
的 驱动 二 序列 terminated 50
传递 线条 在 这 incident 边缘.
ÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁÁ
管脚 函数 描述
管脚 名字 函数 描述
输入
xtal1, xtal2
结晶 输入 这些 管脚 表格 一个 振荡器 当 连接 至 一个 外部 series−resonant
结晶.
s_load* cmos/ttl 串行 获得 输入
(内部的 pulldown 电阻)
这个 管脚 负载 这 配置 latches 和 这 内容 的 这 变换 寄存器. 这
latches 将 是 transparent 当 这个 信号 是 高; 因此, 这 数据 必须 是 稳固的
在 这 high−to−low 转变 的 s_加载 为 恰当的 运作.
s_data* cmos/ttl 串行 数据 输入
(内部的 pulldown 电阻)
这个 管脚 acts 作 这 数据 输入 至 这 串行 配置 变换 寄存器.
s_clock* cmos/ttl 串行 时钟 输入
(内部的 pulldown 电阻)
这个 管脚 serves 至 时钟 这 串行 配置 变换 寄存器. 数据 从 s_数据
是 抽样 在 这 rising 边缘.
p_load** cmos/ttl 并行的 获得 输入
(内部的 pullup 电阻)
这个 管脚 负载 这 配置 latches 和 这 内容 的 这 并行的 输入
.这 latches 将 是 transparent 当 这个 信号 是 低; 因此, 这 并行的
数据 必须 是 稳固的 在 这 low−to−high 转变 的 p_加载
为 恰当的 opera-
tion.
m[8:0]** cmos/ttl pll 循环 分隔物
输入 (内部的 pullup 电阻)
这些 管脚 是 使用 至 配置 这 pll 循环 分隔物. 它们 是 抽样 在 这
low−to−high 转变 的 p_加载. m[8] 是 这 msb, m[0] 是 这 lsb.
n[1:0]** cmos/ttl 输出 分隔物 输入
(内部的 pullup 电阻)
这些 管脚 是 使用 至 配置 这 输出 分隔物 modulus. 它们 是 抽样
在 这 low−to−high 转变 的 p_加载.
OE** cmos/ttl 输出 使能 输入
(内部的 pullup 电阻)
起作用的 高 输出 使能. 这 使能 是 同步的 至 eliminate possibility 的
runt 脉冲波 一代 在 这 f
输出
输出.
fref_ext* cmos/ttl 输入
(内部的 pulldown 电阻)
这个 管脚 能 是 使用 作 这 pll 涉及
xtal_sel** cmos/ttl 输入
(内部的 pullup 电阻)
这个 管脚 选择 在 这 结晶 和 这 fref_ext 源 为 这 pll 谈及-
ence 信号. 一个 高 选择 这 结晶 输入.
输出
F
输出
, f
输出
pecl 差别的 输出 这些 差别的, positive−referenced ecl 信号 (pecl) 是 这 输出 的 这
synthesizer.
测试 pecl 输出 这 函数 的 这个 输出 是 决定 用 这 串行 配置 位 t[2:0].
电源
V
CC
积极的 供应 为 这 逻辑 这 积极的 供应 为 这 内部的 逻辑 和 输出 缓存区 的 这 碎片, 和 是 con-
nected 至 +3.3 v 或者 +5.0 v.
pll_v
CC
积极的 供应 为 这 pll 这个 是 这 积极的 供应 为 这 pll 和 是 连接 至 +3.3 v 或者 +5.0 v.
地 负的 电源 供应 这些 管脚 是 这 负的 供应 为 这 碎片 和 是 正常情况下 所有 连接 至
地面.
* 当 left 打开, 这些 输入 将 default 低.
** 当 left 打开, 这些 输入 将 default 高.
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